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      電子發(fā)燒友網(wǎng)>電子資料下載>通信網(wǎng)絡(luò)>數(shù)字基帶傳輸系統(tǒng)的FPGA設(shè)計(jì)

      數(shù)字基帶傳輸系統(tǒng)的FPGA設(shè)計(jì)

      2011-09-30 | pdf | 388 KB | 次下載 | 免費(fèi)

      資料介紹

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      為了提高系統(tǒng)的集成度和可靠性, 降低功耗和成本, 增強(qiáng)系統(tǒng)的靈活性, 提出一種采用非常高速積體電路的硬件描述語言( VH DL 語言) 來設(shè)計(jì)數(shù)字基帶傳輸系統(tǒng)的方法。詳細(xì)闡述數(shù)字基帶傳輸系統(tǒng)中信號(hào)碼型的設(shè)計(jì)原則, 數(shù)字基帶傳輸系統(tǒng)中信號(hào)編碼原理和譯碼原理; 采用硬件描述語言來設(shè)計(jì)數(shù)字基帶信號(hào)編碼器和譯碼器并進(jìn)行仿真; 采用原理圖設(shè)計(jì)方法設(shè)計(jì)數(shù)字基帶傳輸系統(tǒng)并仿真; 整個(gè)系統(tǒng)的設(shè)計(jì)在Quar tus
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