具有 40MHz、32KB 閃存、6 通道 PWM 的 C2000? 32 位 MCU
| CPU | C28x |
| Frequency (MHz) | 40 |
| Flash memory (KB) | 32 |
| RAM (KB) | 12 |
| ADC resolution | 12-bit |
| Total processing (MIPS) | 40 |
| Features | 32-bit CPU timers, Watchdog timer |
| UART | 1 |
| CAN (#) | 0 |
| Sigma-delta filter | 0 |
| PWM (Ch) | 6 |
| TI functional safety category | Functional Safety Quality-Managed |
- 亮點(diǎn)
- 高效 32 位中央處理單元 (CPU) (TMS320C28x)
- 50-MHz 和 40-MHz 器件
- 3.3-V 單電源
- 集成型加電復(fù)位和欠壓復(fù)位
- 兩個(gè)內(nèi)部零引腳振蕩器
- 多達(dá) 22 個(gè)復(fù)用通用輸入輸出 (GPIO) 引腳
- 三個(gè) 32 位 CPU 定時(shí)器
- 片載閃存，SRAM，OTP 內(nèi)存
- 代碼安全模塊
- 串行端口外設(shè) (SCI/SPI/I2C)
- 增強(qiáng)型控制外設(shè) 多達(dá) 3 個(gè)增強(qiáng)型脈沖寬度調(diào)制器 (ePWM) 模塊，支持多達(dá) 6 個(gè)通道 增強(qiáng)型捕捉 (eCAP) 模數(shù)轉(zhuǎn)換器 (ADC) 片載溫度傳感器 多達(dá) 2 個(gè)比較器 （只適用于 280270）
- 38 引腳和 48 引腳封裝
- 高效 32 位中央處理單元 (CPU) (TMS320C28x)
- 50 MHz （20-ns 周期時(shí)間）
- 40 MHz （25-ns 周期時(shí)間）
- 16 x 16 和 32 x 32 介質(zhì)訪問控制 (MAC) 運(yùn)算
- 16 x 16 雙通道 MAC
- 哈佛 (Harvard) 總線架構(gòu)
- 連動(dòng)運(yùn)算
- 快速中斷響應(yīng)及處理
- 統(tǒng)一內(nèi)存編程模型
- 高效代碼（使用 C/C++ 和匯編語言）
- 字節(jié)序：小端序
- 低器件和系統(tǒng)成本：
- 3.3-V 單電源
- 無需電源排序
- 集成型加電和欠壓復(fù)位
- 可采用低至 38 引腳小型封裝
- 低功率
- 無模擬支持引腳
- 計(jì)時(shí):
- 兩個(gè)內(nèi)部零引腳振蕩器
- 單片晶體振蕩器/外部時(shí)鐘輸入
- 支持動(dòng)態(tài) PLL 比率改變
- 看門狗定時(shí)器模塊
- 丟失時(shí)鐘檢測電路
- 多達(dá) 22 個(gè)具有輸入濾波功能可單獨(dú)編程的多路復(fù)用 GPIO 引腳
- 可支持所有外設(shè)中斷的外設(shè)中斷擴(kuò)展 (PIE) 模塊
- 三個(gè) 32 位 CPU 定時(shí)器
- 每個(gè) ePWM 模塊中的獨(dú)立 16 位定時(shí)器
- 片載存儲(chǔ)器
- 閃存，SRAM，OTP，引導(dǎo) ROM 可用
- 128 位安全密鑰/鎖
- 用于保護(hù)安全內(nèi)存塊
- 可保護(hù)固件逆向工程
- 串行端口外設(shè)
- 一個(gè) SCI (UART) 模塊
- 一個(gè) SPI 模塊
- 一個(gè)內(nèi)部集成電路 (I2C) 總線
- 高級仿真特性
- 分析和斷點(diǎn)功能
- 借助硬件的實(shí)時(shí)調(diào)試
- 2802x0 封裝
- 38 引腳 DA 薄型小外形尺寸封裝 (TSSOP)
- 48 引腳 PT 薄型方形扁平封裝 (LQFP)
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F2802x0 Piccolo 系列微控制器將 C28x 內(nèi)核供電，此內(nèi)核與低引腳數(shù)量器件中的高集成控制外設(shè)相耦合。 該系列的代碼與以往基于 C28x 的代碼相兼容，并且提供了很高的模擬集成度。
一個(gè)內(nèi)部電壓穩(wěn)壓器允許單一電源軌運(yùn)行。 增設(shè)了具有內(nèi)部 10 位基準(zhǔn)的模擬比較器，并可直接對其進(jìn)行路由以控制 PWM 輸出。 ADC 可在 0 V 至 3.3 V 固定全標(biāo)度范圍內(nèi)進(jìn)行轉(zhuǎn)換操作，并支持比例式VREFHI/VREFLO 基準(zhǔn)。 ADC 接口專門針對低開銷/低延遲進(jìn)行了優(yōu)化。
