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電子發(fā)燒友網(wǎng)>可編程邏輯>FPGA/ASIC技術(shù)>降低門檻、成本與功耗,F(xiàn)PGA在AI上發(fā)揮重大價值

降低門檻、成本與功耗,F(xiàn)PGA在AI上發(fā)揮重大價值

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2020-04-28 08:00:00

FPGA功耗設(shè)計小貼士

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FPGA功耗設(shè)計需要注意哪些事項?

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電壓、輸出電壓、輸出/負(fù)載電流和溫度等參數(shù)都是非常重要的信息。系統(tǒng)設(shè)計人員還希望能夠記錄FPGA各種應(yīng)用情況下的功耗,利用這些信息動態(tài)的調(diào)節(jié)某些FPGA性能,或者調(diào)節(jié)系統(tǒng)中不需要的某些部分,以便降低
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FPGA設(shè)計中電源管理

管理和對FPGA 相關(guān)的各種內(nèi)部電壓及I/O 電壓排序。電源管理已成為FPGA 設(shè)計者的一個重要考慮因素,是設(shè)計便攜式、電池供電的產(chǎn)品時。通過功率監(jiān)控設(shè)計技術(shù)能夠減少功耗、增強可靠性、降低成本,并
2012-08-11 16:17:08

FPGA設(shè)計怎么降低功耗

目前許多終端市場對可編程邏輯器件設(shè)計的低功耗要求越來越苛刻。工程師們設(shè)計如路由器、交換機、基站及存儲服務(wù)器等通信產(chǎn)品時,需要密度更大、性能更好的FPGA,但滿足功耗要求已成為非常緊迫的任務(wù)。而在
2019-07-15 08:16:56

FPGA設(shè)計技巧,如何能有效降低靜態(tài)功耗?

4個I/O Bank。多電壓應(yīng)用環(huán)境中比較有利,并且支持熱插拔和施密特觸發(fā)器。ActelIGLOO系列產(chǎn)品的開發(fā)過程中,對靜態(tài)功耗的主要物理來源——漏電流方面做了改進。同時在生產(chǎn)過程中對產(chǎn)率、速度
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降低FPGA功耗的設(shè)計技巧有哪些?

設(shè)計技巧為什么能夠節(jié)省功耗?降低FPGA功耗的設(shè)計技巧有哪些?
2021-04-30 06:04:19

降低FPGA功耗的設(shè)計技術(shù)

降低FPGA功耗的設(shè)計技術(shù) Design Techniques to Reduce Power Consumption Each generation of FPGAs gets
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為什么微軟選擇FPGAAI

。阿呆8年前微軟亞洲研究院參與用FPGA+Open Channel SSD加速Bing搜索引擎的研究,那個時候FPGA做機器學(xué)習(xí)性能已經(jīng)可以甩CPU幾條大街了,同時還能節(jié)省購買服務(wù)器的成本,降低散熱
2018-08-21 09:50:44

為什么要優(yōu)化FPGA功耗?

無論從微觀到宏觀、從延長電池壽命到減少全球變暖的溫室效應(yīng)等等,各種不同因素都在迅速推動系統(tǒng)設(shè)計人員關(guān)注節(jié)能問題。一項有關(guān)設(shè)計優(yōu)先考慮事項的最新調(diào)查指出,大部分工程師已把功耗排在首位,或者是將其緊跟在性能、密度和成本之后。功耗方面,FPGA帶來了獨特的挑戰(zhàn)。為什么要設(shè)計優(yōu)化FPGA功耗?
2019-08-08 07:39:45

什么是低功耗FPGA解決方案?

客戶關(guān)注的問題。降低FPGA功耗降低封裝和散熱成本、提高器件可靠性以及打開移動電子設(shè)備等新興市場之門的關(guān)鍵。
2019-09-20 06:33:32

功耗戰(zhàn)略優(yōu)勢

Altera公司產(chǎn)品和企業(yè)市場副總裁DannyBiran低功耗是一種戰(zhàn)略優(yōu)勢 器件的新應(yīng)用上,FPGA功耗成本結(jié)構(gòu)的改進起到了非常重要的作用。Altera針對低功耗,同時對體系結(jié)構(gòu)和生產(chǎn)工藝進行
2019-07-16 08:28:35

使用這些設(shè)計技巧降低FPGA功耗

映射或布局和布線后設(shè)計的基礎(chǔ)對器件功耗進行估計的。    對于成熟的投產(chǎn)的 FPGA 和 CPLD,XPower 計算出的功耗估計的平均設(shè)計批量誤差 (suite error) 小于 10%。它將
2012-01-11 11:59:44

利用業(yè)界成本最低、功耗最低的FPGA降低系統(tǒng)總成本需要面對哪些挑戰(zhàn)?

市場上已有的解決方案,以降低開發(fā)成本。在當(dāng)今對成本功耗都非常敏感的“綠色”環(huán)境下,對于高技術(shù)企業(yè),兩種挑戰(zhàn)都有什么影響呢?第一種挑戰(zhàn)意味著開發(fā)全新的產(chǎn)品,其功能是獨一無二的,具有較低的價格以及較低
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復(fù)用器重構(gòu)降低FPGA成本

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多核設(shè)計的成本功耗怎么降低?

過去一段時間以來,收益遞減法則(Law of Diminishing Return)傳統(tǒng)處理器架構(gòu)的進展方面已經(jīng)明顯體現(xiàn)出來。每一代新工藝幾何尺寸和新興微架構(gòu)的進步,相應(yīng)性能上所能帶來的增益正在
2019-08-02 06:32:24

如何降低FPGA設(shè)計的功耗?

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如何降低mcu的功耗 ?

功耗mcu的選擇方法如何降低mcu的功耗
2021-02-24 06:11:07

如何降低工業(yè)應(yīng)用的總體擁有成本

降低工業(yè)應(yīng)用的總體擁有成本大約三分之一的嵌入式設(shè)計人員考慮嵌入式應(yīng)用中采用FPGA,只是認(rèn)為設(shè)計中使用FPGA 過于昂貴。但是,從系統(tǒng)級了解總體擁有成本(TCO) ( 由產(chǎn)品生命周期中的開發(fā)
2013-11-13 11:17:35

如何利用FPGA滿足電信應(yīng)用中的降低功耗要求?

充分發(fā)揮功耗優(yōu)勢的公司之一,它是世界最大的電信系統(tǒng)供應(yīng)商之一,可提供基于Altera Stratix IV FPGA的運營商級以太網(wǎng)芯片解決方案。Altera高性能、低功耗技術(shù)與TPACK高度集成
2019-07-31 07:13:26

如何利用賽靈思28納米工藝加速平臺開發(fā)?

全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx Inc.) 宣布,為推進可編程勢在必行之必然趨勢,正對系統(tǒng)工程師全球發(fā)布賽靈思新一代可編程FPGA平臺。和前代產(chǎn)品相比,全新的平臺功耗降低
2019-08-09 07:27:00

如何去提高片系統(tǒng)級集成和降低物料成本

有什么方法可以提高片系統(tǒng)級集成嗎?有什么方法可以降低物料成本嗎?
2021-05-14 06:20:23

如何在降低TCO的同時提高數(shù)據(jù)中心性能?

對于各種不同的數(shù)據(jù)中心工作負(fù)載,FPGA 可以顯著提高性能,最大程度減少附加功耗降低總體擁有成本 (TCO)。
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如何在進行板級設(shè)計時,降低系統(tǒng)的靜態(tài)與動態(tài)功耗?

易失性FPGA的電源特性是什么?如何在進行板級設(shè)計時,降低系統(tǒng)的靜態(tài)與動態(tài)功耗?
2021-04-08 06:47:53

如何才能實現(xiàn)降低FPGA設(shè)計的功耗?

如何才能實現(xiàn)降低FPGA設(shè)計的功耗
2021-04-29 06:47:38

如何設(shè)計才能充分發(fā)揮 FPGA 的作用?

如何設(shè)計才能充分發(fā)揮 FPGA 的作用?請問DSP設(shè)計流程通常包括哪幾個步驟?
2021-04-08 06:10:27

如何采用低功耗28nm FPGA降低系統(tǒng)總成本?

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2019-10-14 06:11:14

實現(xiàn)降低FPGA設(shè)計的動態(tài)功耗的解決方案

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當(dāng)AI遇上FPGA會產(chǎn)生怎樣的反應(yīng)

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2021-09-17 17:08:32

當(dāng)AI遇到FPGA,會發(fā)生什么化學(xué)反應(yīng)呢?

品相比,功耗降低75%。CrossLink-NX FPGA運行解決方案時,sensAI可提供多達2.5Mb的分布式內(nèi)存、RAM塊以及額外的DSP資源,MIPI I/O提供瞬時啟動的性能可在不到
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怎么降低STM32的運行功耗

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有什么方法可以降低Linux的成本嗎?

請問有什么方法可以降低Linux的成本嗎?
2021-04-25 06:15:12

未來課棧@成都棧:不斷降低開發(fā)門檻,用AI能力星云構(gòu)建完整產(chǎn)業(yè)生態(tài)

理解技術(shù),我們會聯(lián)合這些合作伙伴,一起把效果最好用的、以及真正能夠解決用戶需求的一些技術(shù)開放出來,讓大家訊飛開放平臺上一站式地開發(fā),降低大家開發(fā)的門檻成本。”并現(xiàn)場列舉了一些基于訊飛開放平臺AI能力開發(fā)
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淺析FPGA功耗問題

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2014-08-21 15:31:23

電機企業(yè)降低成本的誤區(qū)

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2019-03-07 07:57:19

萊迪思和SiFive最近宣布了一項合作,旨在為開發(fā)人員提供對功耗,小尺寸FPGA運行的可擴展處理器...

應(yīng)用降低成本,功耗和延遲。在數(shù)據(jù)中心之外執(zhí)行處理可以限制隱私和帶寬問題,同時通過提供較低的延遲來確保響應(yīng)速度的提高。 所有這些綜合因素促使未來十年內(nèi),至少有640億個新設(shè)備需要在終端和邊緣使用嵌入式
2020-07-27 17:57:36

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什么是TICKLESS?怎么能實現(xiàn)功耗降低呢?TICKLESS是如何去實現(xiàn)功耗降低的呢?
2022-02-24 08:02:02

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2021-04-13 06:16:21

超低功耗FPGA解決方案助力機器學(xué)習(xí)

本帖最后由 曾12345 于 2018-5-23 15:49 編輯 全新的毫瓦級功耗FPGA解決方案為機器學(xué)習(xí)推理大眾市場物聯(lián)網(wǎng)應(yīng)用中實現(xiàn)快速部署創(chuàng)造機遇。1. 將AI加速部署到快速增長
2018-05-23 15:31:04

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應(yīng)用實例——汽車的視頻分析結(jié)論Cyclone V FPGA降低了總體擁有成本。TSMC的28LP工藝設(shè)計用于盡可能降低功耗,同時也是成本最低的28nm制造工藝。低功耗意味著提高了用戶價值鏈的系統(tǒng)可靠性
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工業(yè)電子產(chǎn)品的發(fā)展趨勢是更小的電路板尺寸、更時尚的外形和更具成本效益。由于這些趨勢,電子系統(tǒng)設(shè)計人員必須降低印刷電路板(PCB)的尺寸和成本。使用現(xiàn)場可編程門陣列(FPGA)和片系統(tǒng)(SoC
2019-03-08 06:45:06

集成電路芯片AI功耗設(shè)計的新方法

近年來,由于對電子設(shè)備的需求不斷增長,低功耗芯片的設(shè)計發(fā)揮了重要作用,這些電子設(shè)備越來越小化,并且功耗越來越低,以支持電池電源。人工智能(AI)的使用 —— 越來越多地出現(xiàn)在可穿戴設(shè)備、物聯(lián)網(wǎng)設(shè)備
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降低FPGA功耗的設(shè)計技巧

新一代 FPGA的速度變得越來越快,密度變得越來越高,邏輯資源也越來越多。那么如何才能確保功耗不隨這些一起增加呢?很多設(shè)計抉擇可以影響系統(tǒng)的功耗,這些抉擇包括從顯見的
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FPGA的低功耗設(shè)計分析

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使用ISE設(shè)計工具優(yōu)化FPGA功耗方案

自從Xilinx推出FPGA二十多年來,研發(fā)工作大大提高了FPGA的速度和面積效率,縮小了FPGA與ASIC之間的差距,使FPGA成為實現(xiàn)數(shù)字電路的優(yōu)選平臺。今天,功耗日益成為FPGA供應(yīng)商及其客戶關(guān)注的問題。降低FPGA功耗是縮減封裝和散熱成本、提高器件可靠性以及打開移
2011-03-15 14:58:3431

首款應(yīng)用Intel 22nm技術(shù)FPGA誕生 功耗成本均減半

FPGA設(shè)計方面最大的難題與挑戰(zhàn)是什么?許多客戶回答都是功耗的控制。隨著FPGA密度和性能的提升,不可避免地帶來了功耗的倍增。FPGA領(lǐng)域的發(fā)展著重圍繞三個關(guān)鍵點:低功耗、低成本
2012-05-04 11:05:261064

LatticeECP4系列:低成本、低功耗FPGA

LatticeECP4 系列:具有高級通信引擎和強大的 DSP 模塊的低成本、低功耗 FPGA 新的LatticeECP4系列是第四代具有高級通信引擎和功能強大的DSP模塊的高可靠、低成本、低功耗FPGA。創(chuàng)新的Latt
2012-06-06 09:51:381924

Cyclone V FPGA:采用低功耗28nm FPGA減少總系統(tǒng)成本

本文主要介紹Cyclone V FPGA的一個很明顯的特性,也可以說是一個很大的優(yōu)勢,即:采用低功耗28nm FPGA減少總系統(tǒng)成本
2012-09-05 15:35:2726

采用低成本FPGA實現(xiàn)高效的低功耗PCIe接口

白皮書 :采用低成本FPGA實現(xiàn)高效的低功耗PCIe接口 了解一個基于DDR3存儲器控制器的真實PCI Express (PCIe) Gen1x4參考設(shè)計演示高效的Cyclone V FPGA怎樣降低系統(tǒng)總成本,同時實現(xiàn)性能和功耗
2013-02-26 10:04:2572

優(yōu)化FPGA功耗的設(shè)計和實現(xiàn)

問題加以考慮,一般來說應(yīng)該從選擇 FPGA 開始。減少FPGA功耗可以降低供電電壓,簡化電源設(shè)計和散熱管理,降低對電源分配面的要求,從而簡化電路板設(shè)計。
2017-11-22 15:03:012573

拒絕AI“部署復(fù)雜、成本高昂”:即插即用的AI相關(guān)應(yīng)用

基于將AI 計算性能植入到邊緣端的應(yīng)用,市場上一方面仍然著重于研究AI計算性能的提升,另一方面,關(guān)于降低 AI應(yīng)用門檻的呼聲也越來越高。而正是在這樣的呼聲之下,我們看到一些企業(yè)開始推廣即插即用的AI相關(guān)應(yīng)用,擬從部署便捷程度、應(yīng)用成本等角度來降低AI 的應(yīng)用門檻!
2017-11-25 09:21:283126

Subtle Medical利用AI降低磁共振成像時間和成本

硅谷的初創(chuàng)公司Subtle Medical正在利用AI大幅降低磁共振成像的時間和資金成本,同時降低輻射暴露的風(fēng)險。
2018-08-09 14:35:194578

Virtex FPGA比前一代產(chǎn)品功耗降低多達50% 成本降低多達20%

設(shè)計周期和更低開發(fā)成本壓力的情況下設(shè)計出“更綠色”的產(chǎn)品。新的Virtex-6 FPGA系列比前一代產(chǎn)品功耗降低多達50%,成本降低多達20%。該系列產(chǎn)品進行了最合適的組合優(yōu)化,包括靈活性、硬內(nèi)核IP
2018-11-15 10:09:02787

XDF 2018:如何降低FPGA成本

reconfigure.io的Rob Taylor在法蘭克福的XDF 2018云軌道中展示了一個用例。 Rob討論了FPGAFPGA中的可訪問性,降低了評估和利用FPGA成本
2018-11-22 06:08:003402

萊迪思宣布進入網(wǎng)絡(luò)邊緣計算市場的AI領(lǐng)域 發(fā)揮FPGA的作用

的關(guān)注點,一場卡位大戰(zhàn)已經(jīng)打響,目前我們看到首先爆發(fā)的是手機的AI芯片,相信接下來還會擴散到更廣泛的終端設(shè)備市場。其中FPGA因為其產(chǎn)品特性,一直被認(rèn)為在云端和網(wǎng)絡(luò)端的AI技術(shù)方面更有發(fā)揮空間,而近日,作為低功耗、小尺寸、低成本FPGA的代言人,萊迪思公司宣布進入網(wǎng)絡(luò)邊緣計算市場的AI領(lǐng)域。
2018-11-23 17:25:41767

探討NLP技術(shù)落地的難點及如何降低開發(fā)者門檻的問題

AI 很火,但是 AI門檻也很高,普通的開發(fā)者想要搭上這波 AI 紅利依然困難。
2019-01-10 09:06:093125

騰訊云發(fā)布大數(shù)據(jù)與AI領(lǐng)域最新成果 致力于降低企業(yè)AI技術(shù)應(yīng)用門檻

12月11日,騰訊云發(fā)布大數(shù)據(jù)與AI領(lǐng)域的最新研究成果,包括AI換臉甄別技術(shù)AntiFakes、騰訊星圖以及企業(yè)畫像平臺等七大新品,并對AI、大數(shù)據(jù)產(chǎn)品進行全線升級,致力于降低企業(yè)AI技術(shù)應(yīng)用門檻。
2019-12-12 09:58:58659

什么樣的FPGA會更好地適用于邊緣AI

FPGA成本、性能、開發(fā)門檻方面都在改變滿足邊緣AI的需求,那到底什么樣的FPGA可以更好滿足邊緣AI需求?
2019-12-16 15:24:18595

Altera Cyclone V FPGA器件可實現(xiàn)降低設(shè)計系統(tǒng)成本功耗

在針對大批量應(yīng)用開發(fā)系統(tǒng)時,要考慮的一個重要因素是成本。有多個方面會影響總體擁有成本,而不僅僅是每個元器件的價格。這包括硅片的功耗要求、材料(BOM)總成本、設(shè)計和測試系統(tǒng)的工程師的效能等。選擇FPGA供應(yīng)商很重要,要考慮影響系統(tǒng)成本的方方面面,這體現(xiàn)在整個產(chǎn)品設(shè)計周期中。
2020-07-17 18:08:341718

戴文淵:希望不斷降低AI使用的門檻成本

、海內(nèi)外院士、商業(yè)領(lǐng)袖、科創(chuàng)精英蒞臨現(xiàn)場,探討新興科技發(fā)展現(xiàn)狀及其為人類社會帶來的巨大影響。第四范式創(chuàng)始人、首席執(zhí)行官戴文淵發(fā)表了主題演講,以下為經(jīng)過整理后的演講實錄: 大家上午好,非常高興有機會能在這邊跟大家交流我們在 AI 驅(qū)動產(chǎn)業(yè)升級方面的一些思考。實際上
2020-11-27 09:30:181633

如何降低功耗FPGA功耗的設(shè)計技巧

并不是所有元件都具有相同的靜止功耗。根據(jù)普遍規(guī)則,器件工藝技術(shù)尺寸越小,泄漏功耗越大。但并不是所有工藝技術(shù)都一樣。例如,對于 90 nm 技術(shù)來說,Virtex-4 器件與其他 90 nm FPGA 技術(shù)之間在靜止功耗方面存在顯著差異,
2021-01-08 17:46:485063

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