- Load:0 second
- Duration:0 second
- Size:0x0
- Volume:0%
- Fps:60fps
- Sudio decoded:0 Byte
- Video decoded:0 Byte
Quartus II design是唯一一個(gè)包括以timing closure 和 基于塊的設(shè)計(jì)流為基本特征的programmable logic device (PLD)的軟件。 Quartus II 設(shè)計(jì)軟件改進(jìn)了性能、提升了功能性、解決了潛在的設(shè)計(jì)延遲等，在工業(yè)領(lǐng)域率先提供FPGA與mask-programmed devices開(kāi)發(fā)的統(tǒng)一工作流程。
聲明：本文內(nèi)容及配圖由入駐作者撰寫(xiě)或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人，不代表電子發(fā)燒友網(wǎng)立場(chǎng)。文章及其配圖僅供工程師學(xué)習(xí)之用，如有內(nèi)容侵權(quán)或者其他違規(guī)問(wèn)題，請(qǐng)聯(lián)系本站處理。
舉報(bào)投訴
-
FPGA
+關(guān)注
關(guān)注
1638文章
21866瀏覽量
610457 -
quartus
+關(guān)注
關(guān)注
17文章
171瀏覽量
74991
發(fā)布評(píng)論請(qǐng)先 登錄
相關(guān)推薦
Quatus使用Nios2時(shí)生成.sof文件帶有time limited
最近購(gòu)買(mǎi)了發(fā)燒友的開(kāi)拓者fpga開(kāi)發(fā)板。目前學(xué)習(xí)Nios2。以hello world例程為例，完全編譯后生成“qsys_hello_world
發(fā)表于 05-28 01:19
【正點(diǎn)原子FPGA連載】第十二章 動(dòng)態(tài)數(shù)碼管顯示實(shí)驗(yàn)
`1）實(shí)驗(yàn)平臺(tái)：正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板2）平臺(tái)購(gòu)買(mǎi)地址：https://item.taobao.com/item.htm?id=5797492098202）全套實(shí)驗(yàn)源碼+手冊(cè)+
發(fā)表于 06-15 22:54
分享正點(diǎn)原子FPGA開(kāi)發(fā)板全套資料
本帖最后由 100dongdong 于 2020-5-16 23:48 編輯
正點(diǎn)原子FPGA開(kāi)拓者開(kāi)發(fā)板，Intel（Altera） FPG
發(fā)表于 05-16 23:35
正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板資料連載第二十一章 VGA圖片顯示實(shí)驗(yàn)
1）實(shí)驗(yàn)平臺(tái)：正點(diǎn)原子開(kāi)拓者FPGA 開(kāi)發(fā)板2）摘自《開(kāi)拓者FPGA開(kāi)發(fā)指南》關(guān)注官方微信號(hào)公眾
發(fā)表于 08-05 11:12
正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板資料連載第二十三章RGBTFT-LCD字符顯示
1）實(shí)驗(yàn)平臺(tái)：正點(diǎn)原子開(kāi)拓者FPGA 開(kāi)發(fā)板2）摘自《開(kāi)拓者FPGA開(kāi)發(fā)指南》關(guān)注官方微信號(hào)公眾
發(fā)表于 08-08 11:03
正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板資料連載第四十三章 以太網(wǎng)通信實(shí)驗(yàn)（2）
1）實(shí)驗(yàn)平臺(tái)：正點(diǎn)原子開(kāi)拓者FPGA 開(kāi)發(fā)板2）摘自《開(kāi)拓者FPGA開(kāi)發(fā)指南》關(guān)注官方微信號(hào)公眾
發(fā)表于 08-24 16:41
正點(diǎn)開(kāi)拓者FPGA開(kāi)發(fā)板使用問(wèn)題
求問(wèn)各位大佬，剛剛?cè)腴T(mén)正點(diǎn)開(kāi)拓者FPGA開(kāi)發(fā)板，用板載pcf8591采集信號(hào)發(fā)生器單一頻率正弦波，再用ip核做fft，結(jié)果和matlab上fft不一樣，請(qǐng)問(wèn)是怎么回事呢？
發(fā)表于 01-04 09:34
FPGA verilog相關(guān)視頻:quartus中的qsys的講解
該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě)，詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻：uC/GUI圖片/數(shù)字顯示實(shí)驗(yàn)
該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě)，詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻：FPGA是什么
正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻
正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻（1）
正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻
正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻：uCOS II任務(wù)管理與時(shí)間管理（2）
該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě)，詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻：自定義IP核之?dāng)?shù)碼管(2)
該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě)，詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻：PIO按鍵控制LED
該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě)，詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻：PIO IRQ
該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě)，詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
工商網(wǎng)監(jiān)
評(píng)論