數(shù)字設(shè)計(jì)FPGA應(yīng)用:74x163回顧
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本課程以目前流行的Xilinx 7系列FPGA的開(kāi)發(fā)為主線(xiàn)，全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語(yǔ)言及VIVADO的應(yīng)用，并循序漸進(jìn)地從組合邏輯、時(shí)序邏輯的開(kāi)發(fā)開(kāi)始，深入到FPGA的基礎(chǔ)應(yīng)用、綜合應(yīng)用和進(jìn)階應(yīng)用。
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FPGA小白
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數(shù)字鐘設(shè)計(jì)。老師要求小時(shí)部分必須用一塊74ls163完成。
數(shù)字鐘。按老師特殊要求特用的一片74ls163實(shí)現(xiàn)的小時(shí)部分。
發(fā)表于 12-16 13:37
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54/741634 位二進(jìn)制同步計(jì)數(shù)器（同步清除）簡(jiǎn)要說(shuō)明163 為可預(yù)置的 4 位二進(jìn)制同步計(jì)數(shù)器，共有 54163/74163、54S163/74S163，54LS163/74LS163
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Counter with Asynchronous ClearMM54HC162/MM74HC162 SynchronousDecade Counter with Synchronous ClearMM54HC163/MM74HC16
發(fā)表于 08-06 09:37
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54LS161A/DM54LS161A/DM74LS161A,54LS163A/DM54LS163A/DM74LS163ASynchronous 4-Bit Binary
發(fā)表于 08-06 12:21
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發(fā)表于 05-08 11:15
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發(fā)表于 04-18 22:03
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