可滿足SIL2對硬件容錯要求的AD7124芯片
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AD7124-8按照19200輸出速率設置，實際五千不到怎么解決？
AD7124-8 直接說設置，
{0x01, 0x04C0, 2, 1}, 全功率，狀態(tài)和數(shù)據(jù)一起傳輸
{0x09, AD7124_CH_EN |AD7124
發(fā)表于 08-01 07:12
AD7124的程序如何將它導出成hex格式呢？
/platforms/SDP_K1/這個等。它的程序我也在網(wǎng)上下載下來了。參見附件。
EVAL-AD7124-3e1005bd4d41.zip
打開后是這樣的，
我的問題是，如果這個文件確實是用于AD7124的程序
發(fā)表于 07-23 08:13
AD7124-8手冊里沒提到上電時序，評估板原理圖是有上電時序的，那電路設計時是否需要上電時序？
AD7124評估板中的AVDD先上電，而后IOVDD才上電。但數(shù)據(jù)手冊中沒有體現(xiàn)，實際設計電路時候是否需要這樣設計呢？
還有一個問題，這里為啥中等功率模式的均方根值噪聲明明小于全功率模式，為啥它
發(fā)表于 07-04 08:31
AD7124-8內部溫度傳感器如何讀取，通道配置如何設置呢？
] - 0x800000) * 10 / 13584 - 2725; //讀AD7124內部溫度,精度0.5°C
發(fā)現(xiàn)溫度比芯片表面溫度總是低了1.5°C左右，我哪里做錯了，請告訴我正常的設置，多謝！
發(fā)表于 07-04 06:52
該如何提高代碼容錯率、降低代碼耦合度？
提高RT-Thread代碼的容錯率和降低耦合度是確保代碼質量和可維護性的關鍵,下面列舉了幾種在編寫代碼時，提高代碼容錯率和降低耦合度的思路。讓我們一起來看看吧~一、提高代碼容錯率輸入驗證與數(shù)據(jù)校驗
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發(fā)表于 05-13 14:19
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AduCM361的ADC校準后得出的結果是錯誤的，是什么原因導致的呢？
AD7124和AD7794兩款ADC的校準資料，對內部校準說的不是很清楚。
在進行內部校準時，失調校準是否需要將兩個輸入選擇為同一個輸入？滿量程校準時如何設置輸入通道？
非常感謝！
發(fā)表于 01-12 06:50
工商網(wǎng)監(jiān)
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