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適用于數(shù)據(jù)交換時(shí)鐘的超低噪聲時(shí)鐘抖動(dòng)消除器SC6301

國(guó)芯思辰(深圳)科技有限公司 ? 2024-02-19 09:41 ? 次閱讀

國(guó)芯思辰SC6301是高性能時(shí)鐘調(diào)節(jié)器,支持JEDEC JESD204B。當(dāng)使用設(shè)備和SYSREF時(shí)鐘時(shí),PLL2的14個(gè)時(shí)鐘輸出可配置去驅(qū)動(dòng)7個(gè)JESD204B轉(zhuǎn)換器或其他邏輯設(shè)備。SYSREF可以使用直流和交流耦合來(lái)提供。不僅限于JESD204B應(yīng)用,14個(gè)輸出均可單獨(dú)配置為傳統(tǒng)高性能時(shí)鐘系統(tǒng)輸出。

超低噪聲時(shí)鐘抖動(dòng)消除器SC6301具有高性能、低功耗、雙VCO、動(dòng)態(tài)數(shù)字延遲、信號(hào)丟失保持等特性。因此,SC6301是提供靈活的高性能時(shí)鐘樹(shù)的理想選擇,國(guó)芯思辰可全程提供技術(shù)支持和供貨需求。

SC6301功能框圖:

SC6301功能框圖.png

SC6301主要性能:

?支持JEDEC JESD204B

?超低RMS抖動(dòng)

76fs RMS Jitter(10kHz到20MHz)

-162dBc/Hz@245.76MHz

?PLL2可提供多達(dá)14路差分時(shí)鐘;最多7個(gè)SYSREF時(shí)鐘;時(shí)鐘最大輸出頻率3.1GHz;支持LVPECL,LVDS,HSDS,LCPECL等輸出接口

?PLL1提供一個(gè)VCXO/Crystal緩沖輸出;支持LVPECL,LVDS,2路LVCMOS等輸出接口

?輸出支持1到32整數(shù)分頻,占空比50%

?高精度數(shù)字延遲,可自適應(yīng)性

?23ps步進(jìn)模擬延遲

?模式:雙PLL, 單PLL, 時(shí)鐘分布

?工作溫度:-40℃到85℃

?工作電壓:3.15V到3.45V,提供QFN-64封裝

SC6301應(yīng)用場(chǎng)景:

無(wú)線基礎(chǔ)設(shè)施,數(shù)據(jù)交換時(shí)鐘,網(wǎng)絡(luò),SONET/SDH, DSLAM

注:如涉及作品版權(quán)問(wèn)題,請(qǐng)聯(lián)系刪除。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場(chǎng)。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問(wèn)題,請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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