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怎樣單獨使用modelsim仿真xilinx呢?

pdh的FPGA ? 來源:pdh的FPGA ? 2023-12-04 18:26 ? 次閱讀

如何使用modelsim仿真xilinx

直接在modelsim軟件內(nèi)執(zhí)行.do文件進(jìn)行仿真,不通過vivado調(diào)用modelsim,vivado僅用于生成IP核。

1.需要vivado軟件安裝路徑下的glbl.v文件

路徑舉例:D:XilinxVivado2017.4dataverilogsrcglbl.v

2.需要編寫sim.do文件

(1). sim.do文件包含了testbench.v文件.

(2).其他源代碼.v/.sv文件.

(3).IP simnetlist.v文件,仿真IP核需要.

3.用一個文件夾,將該兩個文件放同一目錄下,如:

46797af6-928d-11ee-939d-92fbcf53809c.png

4.文件sim.do編寫如下舉例:

vlib work;


vlog glbl.v


Vlog ../../../duc_in_sel_module_5g/dds.v


Vlog ../../../duc_in_sel_module_5g/duc_in_sel_module_5g.v


Vlog ../../../duc_in_sel_module_5g/ip/complex_multiplier_sim_netlist.v


Vlog ../../../duc_in_sel_module_5g/ip/IF_DDS_sim_netlist.v


vlog -sv ../cpri_ctrl_nr/cpri_ctrl_nr_decomp_regroup.sv


vlog -sv ../cpri_ctrl_nr/cpri_ctrl_nr_tx_data_regroup.sv


vlog -sv ../cpri_ctrl_nr/cpri_ctrl_nr_tx_data_sel.sv


vlog -sv ../testbench/tb_xxxx.sv


vsim -t ps -novopt work.tb_xxxx glbl 


-L secureip 


-L simprims_ver 


-L unifast_ver 


-L unimacro_ver 


-L unisims_ver 


-L xpm


log -r /*



以上編寫完成

其中 ../ 為sim.do文件當(dāng)前目錄的上一級文件夾,../../ 則為上兩級文件夾

IF_DDS_sim_netlist.v 就是vivado IP核生成以后,出來的仿真用.v文件

vlib work; 在sim.do文件夾目錄下在創(chuàng)建一個work文件夾

5.打開modelsim窗口

在gui界面輸入

468b094c-928d-11ee-939d-92fbcf53809c.png

cd {sim.do文件路徑}

{}中的內(nèi)容就是sim.do文件的路徑,絕對路徑。

例如

cd {E:cpri_ctrl_topsim}

輸入完成以后,直接輸入 do sim.do 指令

即可






審核編輯:劉清

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原文標(biāo)題:單獨使用modelsim仿真xilinx

文章出處:【微信號:pdh的FPGA,微信公眾號:pdh的FPGA】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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