SPI子系統(tǒng)之SPI時序圖
Tcsb_setup：建立時間
Tcsb_hold：保持時間
tsckl：低電平時間
tsckh：高電平時間
SCK period ：Tsckl + tsckh
一般情況下 Tsckl = tsckh
注意：真實的波形圖如上，高低電平并不是到達最高點才算，0.3Vdd 以下為低電平，0.7Vdd
以上為高電平，計算信號時間長度的時候需要注意這個微小的時間，硬件設(shè)計必須注意信號質(zhì)量風(fēng)險，軟件開發(fā)人員也要會看波形圖。
這里的參數(shù)，一般 spi 驅(qū)動不需要設(shè)置，但是半導(dǎo)體廠商提供的 spi 控制器驅(qū)動中，可以修改這些參數(shù)。我們寫 SPI驅(qū)動時候，可以根據(jù)從設(shè)備的要求來修改這些參數(shù)。
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