降低PCB設(shè)計中噪聲與電磁干擾24條

1、能用低速芯片就不用高速的，高速芯片用在關(guān)鍵地方

2、可用串一個電阻的辦法，降低控制電路上下沿跳變速率

3、盡量為繼電器等提供某種形式的阻尼

4、使用滿足系統(tǒng)要求的最低頻率時鐘

5、時鐘產(chǎn)生器盡量靠近使用時鐘的器件，石英晶體振蕩器外殼要接地

6、用地線將時鐘區(qū)圈起來，時鐘線盡量短

7、I/O 驅(qū)動電路盡量近印刷板邊，讓其盡快離開印刷板。對進(jìn)入印制板的信號要加濾波，從高噪聲區(qū)來的信號也要加濾波，同時用串終端電阻的辦法，減小信號反射

8、MCD無用端要接高或接地，或定義成輸出端，集成電路上該接電源地的端都要接，不要懸空

9、閑置不用的門電路輸入端不要懸空，閑置不用的運放正輸入端接地，負(fù)輸入端接輸出端

10、印制板盡量，使用 45°線而不用 90°線布線以減小高頻信號對外的發(fā)射與耦合

11、印制板按頻率和電流開關(guān)特性分區(qū)，噪聲元件與非噪聲元件要距離再遠(yuǎn)一些

12、單面板和雙面板用單點接電源和單點接地、電源線、地線盡量粗，成本能承受的話用多層板以減小電源，地的容生電感

13、時鐘、總線、片選信號要遠(yuǎn)離 I/O 線和接插件

14、模擬電壓輸入線、參考電壓端要盡量遠(yuǎn)離數(shù)字電路信號線，特別是時鐘

15、對 A/D 類器件，數(shù)字部分與模擬部分寧可統(tǒng)一也不要交叉

16、時鐘線垂直于 I/O 線比平行 I/O 線干擾小，時鐘元件引腳遠(yuǎn)離I/O 電纜

17、元件引腳盡量短，去耦電容引腳盡量短

18、關(guān)鍵的線要盡量粗，并在兩邊加上保護(hù)地。高速線要短且直

19、對噪聲敏感的線不要與大電流，高速開關(guān)線平行

20、石英晶體下面以及對噪聲敏感的器件下面不要走線

21、弱信號電路，低頻電路周圍不要形成電流環(huán)路

22、信號都不要形成環(huán)路，如不可避免，讓環(huán)路區(qū)盡量小

23、每個集成電路一個去耦電容。每個電解電容邊上都要加一個小的高頻旁路電容

24、用大容量的鉭電容或聚酯電容而不用電解電容作電路充放電儲能電容。使用管狀電容時，外殼要接地

鉭電容全稱鉭電解電容，屬于電解電容的一種;電解電容包括鉭電解電容，鋁電解電容，鈮電解電容等;鉭電解電容由于材質(zhì)不同，所以它的濾波效果比鋁電解電容要好，但也有缺點，就是耐電壓不高，電流大時容易爆炸。

審核編輯：湯梓紅