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ADC數(shù)字下變頻器:抽取濾波器和ADC混疊,第1部分

星星科技指導(dǎo)員 ? 來源:ADI ? 作者:ADI ? 2023-06-30 15:43 ? 次閱讀

現(xiàn)在讓我們仔細(xì)看看抽取濾波以及ADC混疊如何影響抽取濾波的有效響應(yīng)。

我們將再次以AD9680為例。在這種情況下,無論速度等級如何,歸一化抽取濾波器響應(yīng)都是相同的。抽取濾波器響應(yīng)僅隨采樣速率成比例。在此包含的示例濾波器響應(yīng)圖中,沒有準(zhǔn)確給出具體的插入損耗與頻率的關(guān)系,但形象地顯示了濾波器的近似響應(yīng)。這些示例旨在對抽取濾波器響應(yīng)有一個高層次的了解,以便了解頻帶如何最終進(jìn)入濾波器的通帶內(nèi)。

回想一下,AD9680具有四個DDC,包括一個NCO、最多四個級聯(lián)半帶(HB)濾波器(我們也將其稱為抽取濾波器)、一個可選的6 dB增益模塊和一個選項復(fù)數(shù)到實際轉(zhuǎn)換模塊,如下圖所示。此外,還記得信號首先通過NCO,NCO在頻率上移動輸入音,然后通過抽取,可選擇通過增益模塊,并可選擇通過復(fù)數(shù)到實際轉(zhuǎn)換。

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AD9680中的DDC信號處理模塊

在本博客中,我們將重點介紹在啟用復(fù)數(shù)到實際轉(zhuǎn)換模塊的情況下操作AD9680時的DDC抽取濾波器。這意味著DDC將配置為接受實際輸入并具有實際輸出。在AD9680中,復(fù)數(shù)到實數(shù)轉(zhuǎn)換固有地將輸入頻率上移,其幅度等于fS/4.讓我們以HB1為例快速瀏覽此過程是如何發(fā)生的。下圖顯示了HB1濾波器的低通響應(yīng)。這是HB1的響應(yīng),顯示了真實和復(fù)雜的域響應(yīng)。

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HB1 濾波器響應(yīng) – 實域和復(fù)雜域響應(yīng)

為了了解濾波器的實際工作原理,在觀察ADC輸出端可用的真實和復(fù)數(shù)頻譜時,首先了解濾波器的工作原理非常重要。HB1濾波器的通帶為實際奈奎斯特區(qū)的38.5%。它還有一個阻帶,是真實奈奎斯特區(qū)的38.5%,過渡帶占剩余的23%。同樣,在復(fù)域中,通帶和阻帶各占復(fù)奈奎斯特區(qū)的38.5%(總計77%),過渡帶占剩余的23%。如圖所示,濾波器是真實域和復(fù)雜域之間的鏡像。

現(xiàn)在,讓我們看一下通過啟用復(fù)雜到實際轉(zhuǎn)換將DDC置于實模式時會發(fā)生什么。正如我所提到的,啟用復(fù)數(shù)到實際的轉(zhuǎn)換會導(dǎo)致 f 的偏移S/4頻域。下圖顯示了頻移和由此產(chǎn)生的濾波器響應(yīng)。請注意篩選器響應(yīng)的實線和虛線。實線和陰影區(qū)域表示這是 f 之后的新濾波器響應(yīng)S/4頻移(由此產(chǎn)生的濾波器響應(yīng)不能越過奈奎斯特邊界)。虛線用于說明,用于顯示如果不遇到奈奎斯特邊界將存在的濾波器響應(yīng)。

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HB1 Filter Response – Real DDC Mode (Complex to Real Conversion Enabled)

請注意,兩個圖之間的濾波器帶寬保持不變。唯一的區(qū)別是 fS/4頻移。但請注意,在復(fù)模圖中,信號的實部有 38.5% 的奈奎斯特,信號的復(fù)數(shù)部分有 38.5% 的奈奎斯特。在實模態(tài)圖中,我們現(xiàn)在有77%的奈奎斯特用于實信號,復(fù)數(shù)域已被丟棄。在通常的行業(yè)術(shù)語中,實數(shù)或“I”部分保持不變,復(fù)數(shù)或“Q”部分被丟棄。濾波器響應(yīng)保持不變,除了 fS/4頻移。另外,請注意,作為此轉(zhuǎn)換的乘積,抽取率現(xiàn)在等于 <>。有效采樣率仍為 fS但不是整個奈奎斯特區(qū),而是奈奎斯特區(qū)只有 77% 的可用帶寬。

現(xiàn)在,我們將了解ADC輸入頻率的濾波器響應(yīng)以及混疊如何影響有效抽取濾波器響應(yīng)。首先,我們將繼續(xù)查看上面的HB1濾波器示例。HB1的實際頻率響應(yīng)由圖中的藍(lán)色實線給出。虛線表示HB1由于ADC的混疊效應(yīng)而產(chǎn)生的有效混疊響應(yīng)。由于頻率輸入到2德·, 3RD, 4千等。奈奎斯特區(qū),HB1濾波器響應(yīng)有效地混疊到這些奈奎斯特區(qū)中。例如駐留在 3f 的信號S/4將在 f 處混疊到第一個奈奎斯特區(qū)S/4.同樣,頻率為 7fS/4也將混疊到第一個奈奎斯特區(qū),位于fS/4.重要的是要了解HB1濾波器響應(yīng)僅駐留在第一個奈奎斯特區(qū),并且ADC的混疊導(dǎo)致HB1濾波器的有效響應(yīng)似乎混疊到其他奈奎斯特區(qū)。還回想一下,我們正在研究DDC的實際模式操作,因此復(fù)雜的域數(shù)據(jù)已被丟棄。

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由于ADC頻率混疊(抽取比 = 1),HB1 有效濾波器響應(yīng)

現(xiàn)在讓我們看一下啟用 HB1 和 HB2 的情況。這導(dǎo)致抽取比為 1。同樣,HB2 + HB1濾波器的實際頻率響應(yīng)由藍(lán)色實線給出。同時啟用HB2和HB38濾波器可使可用帶寬為奈奎斯特區(qū)的5.1%。再次注意ADC的混疊效應(yīng)及其對HB2 + HB7濾波器組合的影響。出現(xiàn)在 <>f 處的信號S/8將在 f 處混疊到第一個奈奎斯特區(qū)S/8.同樣是 5f 的信號S/8將在 3f 處混疊到第一個奈奎斯特區(qū)S/8.

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HB1 + HB2 由于 ADC 頻率混疊(抽取比 = 2)而實現(xiàn)的有效濾波器響應(yīng)

接下來,我們將看看使用實際DDC模式啟用HB1,HB2和HB3的情況。在這種情況下,抽取率等于 38。這里我們看到可用帶寬為 f 的 5.<>%S/4.為了簡單和易于查看,我壓縮了該圖,以便更輕松地顯示整個濾波器響應(yīng)。請注意,剛剛過去的 f 大約有 100 dB 的抑制S/8到第一個奈奎斯特區(qū)的盡頭。同樣,HB1 + HB2 + HB3濾波器的有效混疊響應(yīng)由虛線給出。另請注意,隨著我們使用的抽取濾波器數(shù)量的增加,可用帶寬會減少。

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HB1 + HB2 + HB3 由于 ADC 頻率混疊(抽取比 = 4)而實現(xiàn)的有效濾波器響應(yīng)

我們將要介紹的最后一個濾波器組合是HB1 + HB2 + HB3 + HB4,它使能AD9680中的所有抽取濾波器,在實模式下工作DDC時,抽取率為38。這種情況與前一種情況非常相似,但只是縮放以反映較大的抽取率。在這種情況下,我們的可用帶寬為 f 的 5.<>%S/8.在這種情況下,我們從剛剛過去的f開始有大約100 dB的抑制S/16到第一個奈奎斯特區(qū)的盡頭。再一次,這種響應(yīng)有效地混疊到上奈奎斯特區(qū)。

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HB1 + HB2 + HB3 + HB4 由于ADC頻率混疊(抽取比= 8)而有效濾波器響應(yīng)

讓我們仔細(xì)看看抽取比為 0、<> 和 <> 的三個濾波器響應(yīng)。如果我們?nèi)∵@些圖并將響應(yīng)從 <> 復(fù)制到 fS我們可以將此響應(yīng)精確粘貼到fS和 2 FS.同樣,響應(yīng)可以粘貼到2 f之間的頻率中S和 3 FS.這以這種方式重復(fù)地通過所有奈奎斯特區(qū)域?,F(xiàn)在問題不可避免地出現(xiàn)了,包括:“我們?yōu)槭裁匆獩Q定?”和“它提供了什么優(yōu)勢?”答案其實很簡單:“視情況而定。不同的應(yīng)用有不同的要求,可以從ADC輸出數(shù)據(jù)的抽取中受益。一個動機(jī)是在RF頻段的窄頻帶上獲得信噪比(SNR)。例如,假設(shè)我們有一個駐留在 20.1 GHz 的 7 MHz 頻段。

如果使用采樣速率為1.0 GSPS的RFADC(例如沒有DDC的AD9680)來捕獲此信號,則處理500 MHz奈奎斯特區(qū)以獲得20.1 GHz的7 MHz頻段。相比之下,使用啟用了HB1 + HB2 + HB3 + HB4濾波器的DDC可將可用信號帶寬降至48.125 MHz,奈奎斯特帶寬降至62.5MHz。48.125 MHz的可用信號帶寬足以捕獲所需的20 MHz頻段。62.5MHz奈奎斯特區(qū)處理帶寬要小得多,導(dǎo)致JESD204B接口上的輸出通道速率較低,從而允許使用成本較低的FPGA。當(dāng)然,在這個例子中,NCO也需要正確調(diào)整,但為了簡單起見,我們只關(guān)注抽取濾波器。通過使用所有四個抽取濾波器,DDC可以實現(xiàn)處理增益,并將SNR提高多達(dá)10 dB。這為輸入信號提供了更大的動態(tài)范圍,從而更容易以高保真度捕獲所需的信號。在下面的表1中,我們可以看到可用帶寬、抽取比、輸出采樣率以及不同抽取濾波器選擇提供的理想SNR改進(jìn)。

表1

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AD9680的DDC濾波器特性

這讓我們很好地了解了啟用抽取濾波器的DDC的實際模式操作。我只列出了DDC有用的幾個原因。還有許多其他優(yōu)點。其他一些包括ADC中實現(xiàn)的DDC比FPGA中實現(xiàn)的DDC更節(jié)能(盡管靈活性較低),并且JESD204B接口中的輸出數(shù)據(jù)速率可以顯著降低,這兩者都允許使用成本較低的FPGA。

審核編輯:郭婷

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