大學畢業(yè)設(shè)計一席談之五十 刪余卷積碼仿真(4) 函數(shù)內(nèi)容
繼續(xù)講解！上一篇文章內(nèi)容實在太多了，只能再寫一篇文章公布函數(shù)代碼。函數(shù)內(nèi)容多為編譯碼方面的知識點，如果要想學習捕獲和跟蹤的知識，建議還是再去琢磨前一篇文章。本系列第一篇文章中涉及的相關(guān)函數(shù)除了卷積編譯碼以外的內(nèi)容都可以在本文中找到源碼。
首先看調(diào)制器涉及的函數(shù)！gmsk_mod.m文件中的內(nèi)容。
function [I,Q,g] = gmsk_mod(BURST,Tb,OSR,BT)
[g,q] = ph_g(Tb,OSR,BT);
% PREPARE VECTOR FOR DATA PROCESSING
bits = length(BURST);
f_res = zeros(1,(bits+2)*OSR);
% GENERATE RESULTING FREQUENCY PULSE SEQUENCE
原文標題：大學畢業(yè)設(shè)計一席談之五十 刪余卷積碼仿真(4) 函數(shù)內(nèi)容
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verilog實現(xiàn)卷積運算
的卷積結(jié)果，也是16位有符號數(shù)。
請注意，這個模塊沒有完全實現(xiàn)逐個元素的卷積，而是僅累加了兩個向量的點乘結(jié)果。實際應(yīng)用中，你可能需要添加更多的邏輯來遍歷向量 b 的每個元素，并逐一與向量 a 相乘，然后累加結(jié)果。
發(fā)表于 03-26 07:51
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