SILERGY矽力杰數(shù)據(jù)通信的“指揮官”！

數(shù)據(jù)通信快速發(fā)展，相關(guān)應(yīng)用迅速普及，為滿足海量的數(shù)據(jù)吞吐需求，改善傳輸延時，通信系統(tǒng)和數(shù)據(jù)中心的傳輸速度和處理能力變得至關(guān)重要。時鐘芯片作為這些高性能通信系統(tǒng)和數(shù)據(jù)中心中必不可少的核心芯片，其性能及可靠性將直接影響系統(tǒng)的誤碼率和穩(wěn)定性。

一. 5G通信與時鐘同步

5G基站設(shè)備相比于4G基站，設(shè)備的功耗和傳輸容量增加，基站站點的配套設(shè)備需要進行相應(yīng)的升級擴容。通過采用多載波聚合和大規(guī)模天線陣列等技術(shù)來實現(xiàn)高速率、低延時。它匯聚了多頻點協(xié)同傳輸數(shù)據(jù)和多天線通道同步收發(fā)數(shù)據(jù)等技術(shù)，而這些技術(shù)都對時鐘有高度嚴(yán)格的同步要求。

矽力杰最新推出SQ82201 是一款10路輸出的高性能時鐘發(fā)生器，集成模擬鎖相環(huán)，具有強大的頻率合成、抖動濾除、超低時延等功能。廣泛應(yīng)用于5G AAU，小基站，通信系統(tǒng)，服務(wù)器等。有效滿足各類通信設(shè)備的時鐘同步需求。

二. 矽力杰時鐘發(fā)生器方案

SQ82201 是一款10路輸出的高性能時鐘發(fā)生器，其中包括3路LVPECL差分輸出和7路單端輸出。SQ82201內(nèi)部集成低噪聲鑒相器(PFD)，電荷泵(CP)，環(huán)路濾波器，低相位噪聲高頻壓控振蕩器(VCO)和輸出整數(shù)分頻器。

SQ82201 高性能10路輸出時鐘發(fā)生器

◆ 7路單端LVCMOS輸出：

? 一個單端LVCMOS的33.33 MHz CPU時鐘

? 六路單端LVCMOS輸出用于參考時鐘緩沖

◆ 3路差分LVPECL輸出對

◆ 可選擇的外部晶體或單端輸入?yún)⒖荚?/p>

◆ 為25MHz并聯(lián)諧振晶體設(shè)計的晶振接口

◆ 156.25MHz輸出, RMS相位抖動: <0.15ps (12kHz~20MHz)

◆ 電源噪聲抑制PSRR: -80dBc

◆ 電源電壓: 3.3V

◆ 緊湊型封裝: QFN6×6-40

◆ 工作溫度: -40~85°C

如圖為SQ82201系統(tǒng)框圖，SQ82201能夠通過硬件管腳選擇本地?zé)o源晶振或者外部參考時鐘。同時也支持通過硬件管腳選擇輸出頻點組合以及輸出使能。

傳統(tǒng)的系統(tǒng)設(shè)計中，各個數(shù)字芯片需要的工作時鐘信號頻率各不相同。在設(shè)計中采用多個獨立的晶振時鐘源給各個數(shù)字芯片提供時鐘信號，往往會造成系統(tǒng)成本高，電路板面積大，設(shè)計復(fù)雜，且會產(chǎn)生各芯片間時鐘無法同步的問題，給系統(tǒng)設(shè)計帶來額外的開銷。

當(dāng)系統(tǒng)采用SQ82201時鐘發(fā)生器，即可通過其中的高性能高頻VCO鎖定輸入選定的參考時鐘。同時產(chǎn)品內(nèi)部集成整數(shù)分頻器，可實現(xiàn)輸出多路頻率各不相同的高性能時鐘，滿足系統(tǒng)多個芯片的時鐘頻點和性能需求。高集成度的時鐘發(fā)生器，能夠進一步縮小芯片及外圍電路尺寸，有助于滿足現(xiàn)有和未來的基站通信的設(shè)計需求。

三. 應(yīng)用場景

在衡量時鐘信號質(zhì)量時經(jīng)常會提到抖動和相位噪聲，二者分別從時域和頻域的維度表征時鐘信號短期頻率穩(wěn)定度。

SQ82201差分輸出抖動分別如下所示：

156.25MHz: 109fs (12kHz~20MHz)

100MHz: 116fs (12KHz~20MHz)

目前主流的數(shù)據(jù)通信系統(tǒng)中，由于各個系統(tǒng)的數(shù)據(jù)速率、收發(fā)通道時鐘恢復(fù)電路的帶寬不同，對于鏈路時鐘抖動的要求和積分帶寬會略有不同。

SQ82201優(yōu)越的抖動性能，符合當(dāng)前所有主流通信系統(tǒng)時鐘抖動的要求，為客戶提供高集成度，極簡外圍電路的時鐘發(fā)生器解決方案，有效滿足5G通信等應(yīng)用領(lǐng)域的時鐘同步需求。

審核編輯黃宇