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HC89S003AF4/HC89S001AJ4 20/8 引腳 8 位 ADC 型 FLASH 單片機(jī) 外設(shè)功能引腳全映射

jf_95732097 ? 來(lái)源: jf_95732097 ? 作者: jf_95732097 ? 2023-05-22 10:34 ? 次閱讀

HC89S003AF4/HC89S001AJ4是一顆采用高速低功耗 CMOS 工藝設(shè)計(jì)開(kāi)發(fā)的增強(qiáng)型 8 位單片機(jī),內(nèi)部有 16K Bytes FLASH 程序存儲(chǔ)器,256Bytes IRAM+768Bytes XRAM,最多 18 個(gè)雙向 I/O 口,5 個(gè) 16 位定時(shí)器 /計(jì)數(shù)器,3 組 12 位帶死區(qū)控制互補(bǔ) PWM,1 路 8 位 PWM,2 個(gè) UART,1 個(gè) SPI,1 個(gè) IIC,16 個(gè)外部 中斷,16+2 路 12 位 ADC,1 個(gè)低壓檢測(cè)模塊,四種系統(tǒng)工作模式和多個(gè)中斷源。

特點(diǎn)→

pYYBAGRq0jiAUh-AAAH6iWjIqDY715.png

V:runzexin-18

pYYBAGRq0lGAESHdAADJddh3G7M679.png

命名規(guī)則

1. 為保證系統(tǒng)的穩(wěn)定性,必須在VDD和GND之間接一電容(容值須大于或等于0.1μF)。

2. 可以直接燒錄HC89S003F4的燒錄文件,但需要將HC-PM51燒錄器的固件版本升級(jí)到最新版。

3. P2.7引腳出廠(chǎng)時(shí)默認(rèn)為復(fù)位管腳,端口模式為施密特輸入帶上拉,可以通過(guò)配置代碼選項(xiàng)將此口配 置為普通IO引腳。

4. 在進(jìn)行IAP操作時(shí),不響應(yīng)任何中斷。

5. ADCEN 置 1 或切換轉(zhuǎn)換通道后,建議延時(shí) 20us 后再啟動(dòng) ADC 轉(zhuǎn)換,如果外部輸入阻抗很大時(shí), 需要延長(zhǎng)這個(gè)時(shí)間。

6. 當(dāng) ADC 的參考電壓為 VDD 時(shí),ADC 轉(zhuǎn)換時(shí)鐘可以為 8MHz,一次轉(zhuǎn)換只需要 15 個(gè) ADC_CLK, 這樣可以得到最快的 ADC 轉(zhuǎn)換速度。

7. P2.7、P2.5、P2.4、P2.3 這四個(gè)端口的模式配置和其他端口的不一樣,請(qǐng)仔細(xì)看 7.4.6 小節(jié)。

8. 使用 PWM3 時(shí),要先配置時(shí)鐘分頻、周期、占空比等寄存器,最后再使能 PWM3 模塊。

9. UART2 在使用全雙工時(shí),需要配置 CPU 頻率為 16MHz 以上,波特率配置 9600 或以下,而且在 UART2 中斷服務(wù)函數(shù)里盡早清零 TI 或 RI,請(qǐng)參考相關(guān)例程。

10. 在LVD中斷中,若要關(guān)閉比較器或LVD中斷,應(yīng)先禁止 LVD/比較器,再失能LVD中斷允許位。

11. 在使用LVD比較器功能的時(shí)候,如果比較器輸出狀態(tài)(CMPSTA)為高(即比較器正端電壓大于負(fù) 端電壓),則芯片無(wú)法進(jìn)入掉電/空閑模式。

12. QFN20 的封裝片中間的焊盤(pán)是與 PIN5(VDD)相連接的。

HC89S003A/001A 單片機(jī)系統(tǒng)時(shí)鐘有 4 種時(shí)鐘源可選:

? 外部高頻晶振時(shí)鐘(4MHz~20MHz)

? 外部低頻晶振時(shí)鐘(32.768KHz)

? 內(nèi)部高頻 RC 時(shí)鐘(32MHz)

? 內(nèi)部低頻 RC 時(shí)鐘(44KHz)

用戶(hù)選擇后的系統(tǒng)時(shí)鐘(如果選擇的是內(nèi)部高頻 RC,則經(jīng) RC32M_DIV[1:0]分頻后的時(shí)鐘)記做 osc_clk,其頻率為 Fosc,周期為 Tosc,主要用于外設(shè)模塊,osc_clk 可以進(jìn)行 1-255 之間任意值的分頻, 分頻后的時(shí)鐘記做 CPU 時(shí)鐘,其頻率為 Fcpu,周期為 Tcpu。

芯片上電復(fù)位后,默認(rèn)選擇內(nèi)部高頻 RC 作為系統(tǒng)時(shí)鐘,其 Fosc 為 4MHz,F(xiàn)cpu 為 2MHz,可以通過(guò) 配置相關(guān)寄存器改變 osc_clk 和 cpu_clk 的頻率。

CPU 最高可以運(yùn)行在 16MHz 頻率下,如果所選時(shí)鐘源頻率高于 16MHz,需要對(duì)其進(jìn)行分頻,使 CPU 時(shí)鐘頻率等于或低于 16MHz。

poYBAGRq092AZIH6AABMPA7V6wg022.png

系統(tǒng)時(shí)鐘框圖

本文章僅展現(xiàn)了產(chǎn)品一部分內(nèi)容 具體內(nèi)容可咨詢(xún)。

審核編輯黃宇

聲明:本文內(nèi)容及配圖由入駐作者撰寫(xiě)或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀(guān)點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場(chǎng)。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問(wèn)題,請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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