0
  • 聊天消息
  • 系統(tǒng)消息
  • 評論與回復(fù)
登錄后你可以
  • 下載海量資料
  • 學(xué)習(xí)在線課程
  • 觀看技術(shù)視頻
  • 寫文章/發(fā)帖/加入社區(qū)
會員中心
电子发烧友
开通电子发烧友VIP会员 尊享10大特权
海量资料免费下载
精品直播免费看
优质内容免费畅学
课程9折专享价
創(chuàng)作中心

完善資料讓更多小伙伴認識你,還能領(lǐng)取20積分哦,立即完善>

3天內(nèi)不再提示

AXI3與AXI4寫響應(yīng)的依賴區(qū)別?

全棧芯片工程師 ? 來源:全棧芯片工程師 ? 2023-03-30 09:59 ? 次閱讀

注意AXI3通道之間的寫依賴:

7ac10c46-ce59-11ed-bfe3-dac502259ad0.png

注意AXI4通道之間的寫依賴:

7ade1e1c-ce59-11ed-bfe3-dac502259ad0.png

上面兩圖的區(qū)別是相比AXI3,AXI4協(xié)議需要確認AWVALID、AWREADY握手完成才能回復(fù)BVALID。






審核編輯:劉清

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
  • mcu
    mcu
    +關(guān)注

    關(guān)注

    146

    文章

    17691

    瀏覽量

    357759
  • AXI總線
    +關(guān)注

    關(guān)注

    0

    文章

    66

    瀏覽量

    14463

原文標題:考考你?:AXI3與AXI4寫響應(yīng)的依賴區(qū)別?

文章出處:【微信號:全棧芯片工程師,微信公眾號:全棧芯片工程師】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

收藏 0人收藏

    評論

    相關(guān)推薦

    如何使用AXI VIP在AXI4(Full)主接口中執(zhí)行驗證和查找錯誤

    AXI 基礎(chǔ)第 2 講 一文中,曾提到賽靈思 Verification IP (AXI VIP) 可用作為 AXI 協(xié)議檢查工具。在本次第4講中,我們將來了解下如何使用它在
    發(fā)表于 07-08 09:31 ?3340次閱讀

    AXI接口FIFO簡介

    AXI接口FIFO是從Native接口FIFO派生而來的。AXI內(nèi)存映射接口提供了三種樣式:AXI4、AXI3AXI4-Lite。除了Na
    的頭像 發(fā)表于 03-17 10:31 ?646次閱讀
    <b class='flag-5'>AXI</b>接口FIFO簡介

    看看在SpinalHDL中AXI4總線互聯(lián)IP的設(shè)計

    。writeIssuingCapability:指明AXI4總線最大同時支持的指令個數(shù)。combinedIssuingCapability:其值應(yīng)不小于前兩者,用于在AXI4總線讀寫地址通道共用的場景
    發(fā)表于 08-02 14:28

    看看Axi4通道decoder的設(shè)計

    讀寫分離的設(shè)計在Axi4總線中,讀和通道是完全相互獨立,互不干擾。故而無論是在設(shè)計Decoder還是Arbiter時,均可以采用讀寫分離的方式。如前文所述,SpinalHDL在基于Axi4總線
    發(fā)表于 08-03 14:27

    AXI4接口協(xié)議的基礎(chǔ)知識

    AXI-4 Memory Mapped也被稱之為AXI-4 Full,它是AXI4接口協(xié)議的基礎(chǔ),其他AXI4接口是該接口的變形??傮w而言,AXI-
    的頭像 發(fā)表于 09-23 11:20 ?6330次閱讀
    <b class='flag-5'>AXI4</b>接口協(xié)議的基礎(chǔ)知識

    一文詳解ZYNQ中的DMA與AXI4總線

    在ZYNQ中,支持AXI-Lite,AXI4AXI-Stream三種總線,但PS與PL之間的接口卻只支持前兩種,AXI-Stream只能在PL中實現(xiàn),不能直接和PS相連,必須通過
    的頭像 發(fā)表于 09-24 09:50 ?5905次閱讀
    一文詳解ZYNQ中的DMA與<b class='flag-5'>AXI4</b>總線

    何謂 AXI?關(guān)于AXI3/AXI4的相關(guān)基礎(chǔ)知識

    新的賽靈思器件設(shè)計中不可或缺的一部分。充分了解其基礎(chǔ)知識對于賽靈思器件的設(shè)計和調(diào)試都很有幫助。 本篇博文將介紹賽靈思器件上的 AXI3/AXI4 的相關(guān)基礎(chǔ)知識。首先,我們將從一些通俗易懂的知識、理論
    的頭像 發(fā)表于 09-27 11:06 ?6987次閱讀
    何謂 <b class='flag-5'>AXI</b>?關(guān)于<b class='flag-5'>AXI3</b>/<b class='flag-5'>AXI4</b>的相關(guān)基礎(chǔ)知識

    ZYNQ中DMA與AXI4總線

    ZYNQ中DMA與AXI4總線 為什么在ZYNQ中DMA和AXI聯(lián)系這么密切?通過上面的介紹我們知道ZYNQ中基本是以AXI總線完成相關(guān)功能的: 圖4?34連接 PS 和 PL 的
    的頭像 發(fā)表于 11-02 11:27 ?4521次閱讀
    ZYNQ中DMA與<b class='flag-5'>AXI4</b>總線

    深入AXI4總線一握手機制

    本系列我想深入探尋 AXI4 總線。不過事情總是這樣,不能我說想深入就深入。當前我對 AXI總線的理解尚談不上深入。但我希望通過一系列文章,讓讀者能和我一起深入探尋 AXI4。
    發(fā)表于 03-17 21:40 ?25次下載
    深入<b class='flag-5'>AXI4</b>總線一握手機制

    AXI4 、 AXI4-Lite 、AXI4-Stream接口

    AXI4 是一種高性能memory-mapped總線,AXI4-Lite是一只簡單的、低通量的memory-mapped 總線,而 AXI4-Stream 可以傳輸高速數(shù)據(jù)流。從字面意思去理解
    的頭像 發(fā)表于 07-04 09:40 ?9276次閱讀

    AXI4協(xié)議五個不同通道的握手機制

    AXI4 協(xié)議定義了五個不同的通道,如 AXI 通道中所述。所有這些通道共享基于 VALID 和 READY 信號的相同握手機制
    的頭像 發(fā)表于 05-08 11:37 ?1494次閱讀
    <b class='flag-5'>AXI4</b>協(xié)議五個不同通道的握手機制

    FPGA AXI4協(xié)議學(xué)習(xí)筆記(二)

    上文FPGA IP之AXI4協(xié)議1_協(xié)議構(gòu)架對協(xié)議框架進行了說明,本文對AXI4接口的信號進行說明。
    的頭像 發(fā)表于 05-24 15:05 ?1837次閱讀
    FPGA <b class='flag-5'>AXI4</b>協(xié)議學(xué)習(xí)筆記(二)

    Xilinx FPGA AXI4總線(一)介紹【AXI4】【AXI4-Lite】【AXI-Stream】

    從 FPGA 應(yīng)用角度看看 AMBA 總線中的 AXI4 總線。
    發(fā)表于 06-21 15:21 ?2632次閱讀
    Xilinx FPGA <b class='flag-5'>AXI4</b>總線(一)介紹【<b class='flag-5'>AXI4</b>】【<b class='flag-5'>AXI4</b>-Lite】【<b class='flag-5'>AXI</b>-Stream】

    SoC設(shè)計中總線協(xié)議AXI4AXI3的主要區(qū)別詳解

    AXI4AXI3是高級擴展接口(Advanced eXtensible Interface)的兩個不同版本,它們都是用于SoC(System on Chip)設(shè)計中的總線協(xié)議,用于處理器和其它外設(shè)之間的高速數(shù)據(jù)傳輸。
    的頭像 發(fā)表于 05-10 11:29 ?9186次閱讀
    SoC設(shè)計中總線協(xié)議<b class='flag-5'>AXI4</b>與<b class='flag-5'>AXI3</b>的主要<b class='flag-5'>區(qū)別</b>詳解

    AMBA AXI4接口協(xié)議概述

    AMBA AXI4(高級可擴展接口 4)是 ARM 推出的第四代 AMBA 接口規(guī)范。AMD Vivado Design Suite 2014 和 ISE Design Suite 14 憑借半導(dǎo)體產(chǎn)業(yè)首個符合 AXI4 標準的
    的頭像 發(fā)表于 10-28 10:46 ?583次閱讀
    AMBA <b class='flag-5'>AXI4</b>接口協(xié)議概述

    電子發(fā)燒友

    中國電子工程師最喜歡的網(wǎng)站

    • 2931785位工程師會員交流學(xué)習(xí)
    • 獲取您個性化的科技前沿技術(shù)信息
    • 參加活動獲取豐厚的禮品