MAX77812為四相、大電流、降壓轉(zhuǎn)換器,適用于高端游戲機、VR/AR耳機、數(shù)碼單反相機、無人機、網(wǎng)絡(luò)交換機和路由器,以及使用多核處理器的FPGA系統(tǒng)。MAX77812具有工廠可編程OTP(一次性可編程)選項,用于定制啟動順序和用于關(guān)斷序列的單獨寄存器設(shè)置。本文檔說明如何對這些寄存器進行編程,并提供一個示例。
介紹
MAX77812支持主相之間的可編程啟動和關(guān)斷。啟動和關(guān)斷序列由 GPI 的 EN 引腳或GLB_EN功能啟動。主相之間的啟動和關(guān)斷延遲時間可在0ms至62ms (32級)范圍內(nèi)設(shè)置,延遲時間步長為1ms/2ms。
啟動和關(guān)斷順序設(shè)置
啟動順序由STUP_DLYx寄存器設(shè)置,默認值為工廠編程選項(有關(guān)詳細信息,請參見數(shù)據(jù)手冊中的“訂購信息”部分),而關(guān)斷延遲寄存器(SHDN_DLYx)的默認值是固定的,默認情況下主相之間沒有延遲時間。
當CE引腳為高電平(待機模式)時,用戶可以通過串行接口覆蓋啟動和關(guān)斷寄存器。
請注意,一旦啟動序列,M1(主1)始終處于打開狀態(tài),沒有可編程延遲。
如果在啟動或關(guān)斷序列之前,GPI0/1 的 EN_Mx 位或Mx_EN功能打開了任何主相,則啟動或關(guān)斷事件對已打開的主相是透明的。
例如,如果我們希望在10+1+1+1相配置的主相之間有1ms的延遲時間,STUP_DLYx寄存器可以按如下方式編程(寄存器編程詳細信息見表1至表7):
延遲時間步長:通過設(shè)置 DLY_STEP = 1 為 0ms
從 M1 到 M2 的延遲時間:通過設(shè)置 M10_STUP_DLY[2:4] = 0b 為 01010ms
從 M1 到 M3 的延遲時間:通過設(shè)置 M20_STUP_DLY[3:4] = 0b 為 10100ms
從 M1 到 M4 的延遲時間:通過設(shè)置 M30_STUP_DLY[4:4] = 0b 為 11110ms
圖1中的圖表顯示了典型的啟動和關(guān)斷順序。
圖1.啟動和關(guān)閉順序。
地址 0x07 |
模式 R/W |
類型: O | 復(fù)位值:0x00 (OTP) | |
---|---|---|---|---|
位 | 名字 | 波爾 | 描述 | |
7 | DLY_STEP | 0 |
延遲時間步長選擇 0: 1ms 1: 2ms |
|
6:5 | 保留 | 00 | ||
4:0 | M2_STUP_DLY[4:0] | 0 0000 |
降壓穩(wěn)壓主控 2 啟動延遲時間設(shè)置(從 EN 引腳或 GLB_EN 上升沿的延遲) 0 0000b = 0ms 0 0001b = 1 x DLY_STEP 0 0010b = 2 x DLY_STEP · · · · · · 1 1110b = 30 x DLY_STEP 1 1111b = 31 x DLY_STEP |
地址 0x08 |
模式 R/W |
類型: O | 復(fù)位值:0x00 (OTP) | |
---|---|---|---|---|
位 | 名字 | 波爾 | 描述 | |
7:5 | 保留 | 000 | ||
4:0 | M3_STUP_DLY[4:0] | 0 0000 |
降壓穩(wěn)壓主控 3 啟動延遲時間設(shè)置(從 EN 引腳或 GLB_EN 上升沿的延遲) 0 0000b = 0ms 0 0001b = 1 x DLY_STEP 0 0010b = 2 x DLY_STEP · · · · · · 1 1110b = 30 x DLY_STEP 1 1111b = 31 x DLY_STEP |
地址 0x09 |
模式 R/W |
類型: O | 復(fù)位值:0x00 (OTP) | |
---|---|---|---|---|
位 | 名字 | 波爾 | 描述 | |
7:5 | 保留 | 000 | ||
4:0 | M4_STUP_DLY[4:0] | 0 0000 |
降壓穩(wěn)壓主控 4 啟動延遲時間設(shè)置(從 EN 引腳或 GLB_EN 上升沿的延遲) 0 0000b = 0ms 0 0001b = 1 x DLY_STEP 0 0010b = 2 x DLY_STEP · · · · · · 1 1110b = 30 x DLY_STEP 1 1111b = 31 x DLY_STEP |
地址 0x0A |
模式 R/W |
類型: O | 復(fù)位值:0x00 (OTP) | |
---|---|---|---|---|
位 | 名字 | POR | 描述 | |
7:5 | 保留 | 000 | ||
4:0 | M1_SHDN_DLY[4:0] | 0 0000 |
降壓穩(wěn)壓主控器 1 關(guān)斷延遲時間設(shè)置(來自 EN 引腳或 GLB_EN 下降沿的延遲) 0 0000b = 0ms 0 0001b = 1 x DLY_STEP 0 0010b = 2 x DLY_STEP · · · · · · 1 1110b = 30 x DLY_STEP 1 1111b = 31 x DLY_STEP |
地址 0x0B |
模式 R/W |
類型: O | 復(fù)位值:0x00 (OTP) | |
---|---|---|---|---|
位 | 名字 | POR | 描述 | |
7:5 | 保留 | 000 | ||
4:0 | M2_SHDN_DLY[4:0] | 0 0000 |
降壓穩(wěn)壓主控器 2 關(guān)斷延遲時間設(shè)置(來自 EN 引腳或 GLB_EN 下降沿的延遲) 0 0000b = 0ms 0 0001b = 1 x DLY_STEP 0 0010b = 2 x DLY_STEP · · · · · · 1 1110b = 30 x DLY_STEP 1 1111b = 31 x DLY_STEP |
地址 0x0C |
模式 R/W |
類型: O | 復(fù)位值:0x00 (OTP) | |
---|---|---|---|---|
位 | 名字 | POR | 描述 | |
7:5 | 保留 | 000 | ||
4:0 | M4_SHDN_DLY[4:0] | 0 0000 |
降壓穩(wěn)壓主控器 4 關(guān)斷延遲時間設(shè)置(來自 EN 引腳或 GLB_EN 下降沿的延遲) 0 0000b = 0ms 0 0001b = 1 x DLY_STEP 0 0010b = 2 x DLY_STEP · · · · · · 1 1110b = 30 x DLY_STEP 1 1111b = 31 x DLY_STEP |
地址 0x0D |
模式 R/W |
類型: O | 復(fù)位值:0x00 (OTP) | |
---|---|---|---|---|
位 | 名字 | POR | 描述 | |
7:5 | 保留 | 000 | ||
4:0 | M3_SHDN_DLY[4:0] | 0 0000 |
降壓穩(wěn)壓主控器 3 關(guān)斷延遲時間設(shè)置(來自 EN 引腳或 GLB_EN 下降沿的延遲) 0 0000b = 0ms 0 0001b = 1 x DLY_STEP 0 0010b = 2 x DLY_STEP · · · · · · 1 1110b = 30 x DLY_STEP 1 1111b = 31 x DLY_STEP |
審核編輯:郭婷
-
處理器
+關(guān)注
關(guān)注
68文章
19286瀏覽量
229873 -
FPGA
+關(guān)注
關(guān)注
1629文章
21738瀏覽量
603464 -
寄存器
+關(guān)注
關(guān)注
31文章
5343瀏覽量
120385
發(fā)布評論請先 登錄
相關(guān)推薦
評論