作者:Hugh Yu, Gina Kelso, and Ashraf Saad
隨著醫(yī)療超聲在醫(yī)療診斷領(lǐng)域的廣泛應(yīng)用,醫(yī)生對(duì)超聲圖像系統(tǒng)圖像質(zhì)量的要求越來越高,而提高圖像質(zhì)量的關(guān)鍵技術(shù)之一是提高接收通道的信噪比。隨著系統(tǒng)中接收通道數(shù)量的增加一倍,信噪比理論上應(yīng)該提高3 dB。因此,增加系統(tǒng)通道數(shù)量已成為加強(qiáng)信噪比的最簡(jiǎn)單有效的方法。目前,128通道已成功成為中高級(jí)醫(yī)療超聲設(shè)備的主流配置,192通道或更多通道將成為高端系統(tǒng)的下一個(gè)趨勢(shì)。隨著通道數(shù)量的增加,模擬前端和后端數(shù)字處理以及物理連接之間的數(shù)據(jù)速率急劇增加。它們還會(huì)導(dǎo)致數(shù)字電路器件接口的數(shù)量、處理能力、成本、整個(gè)接收器電路的設(shè)計(jì)復(fù)雜性以及相應(yīng)的功耗增加。目前,超聲系統(tǒng)使用射頻(RF)波束成形。輸出數(shù)據(jù)速率完全取決于模數(shù)轉(zhuǎn)換器(ADC)的分辨率、采樣速率和通道數(shù)。同時(shí),模擬前端(AFE)通常使用低壓差分信號(hào)(LVDS)輸出接口。八通道AFE需要八對(duì)LVDS數(shù)據(jù)線以及一對(duì)數(shù)據(jù)時(shí)鐘和幀時(shí)鐘。對(duì)于擁有超過 128 個(gè)通道的系統(tǒng),有大量的數(shù)據(jù)和物理連接。
本文介紹了一種基于八通道AFE的數(shù)字解調(diào)器和JESD204B接口的超聲接收通道設(shè)計(jì)方案,有效解決了上述系統(tǒng)數(shù)據(jù)速率大、物理連接復(fù)雜帶來的設(shè)計(jì)難題。
系統(tǒng)架構(gòu)
超聲系統(tǒng)由探頭(換能器)、發(fā)射電路、接收電路、后端數(shù)字處理電路、控制電路、顯示模塊等組成。圖1是帶有JESD204B接口的128通道超聲系統(tǒng)發(fā)送/接收路徑框圖。數(shù)字處理模塊通常包括現(xiàn)場(chǎng)可編程門陣列(FPGA),根據(jù)系統(tǒng)的當(dāng)前配置和控制參數(shù)生成相應(yīng)的波形。然后,發(fā)射電路的驅(qū)動(dòng)器和高壓電路產(chǎn)生高電壓以激勵(lì)超聲換能器。超聲換能器通常由壓電陶瓷換能器(PZT)制成。它將電壓信號(hào)轉(zhuǎn)換為超聲波,進(jìn)入人體,同時(shí)接收組織產(chǎn)生的回波。然后將回波轉(zhuǎn)換為電壓信號(hào)并傳輸?shù)桨l(fā)送/接收(T/R)開關(guān)電路。T/R開關(guān)電路的主要目的是防止高壓發(fā)射信號(hào)損壞低壓接收模擬前端。經(jīng)過信號(hào)調(diào)理、增益和濾波后的模擬電壓信號(hào)被傳遞到AFE的集成ADC,然后轉(zhuǎn)換為數(shù)字?jǐn)?shù)據(jù),然后通過JESD204B接口傳輸?shù)胶蠖藬?shù)字部分進(jìn)行相應(yīng)的處理,最終創(chuàng)建超聲圖像。接收通道由一個(gè)128通道T/R開關(guān)電路、一個(gè)帶數(shù)字解調(diào)器和JESD204B接口的16八通道超聲AFE器件以及一個(gè)帶JESD204B接口的FPGA組成。
圖1.128通道超聲系統(tǒng)框圖。
AD9671: 八通道超聲AFE,內(nèi)置數(shù)字解調(diào)器和JESD204B接口
AD9671是八通道超聲AFE,內(nèi)置ADI公司(ADI)的數(shù)字解調(diào)器和JESD204B接口,被選用于該超聲系統(tǒng)接收電路。它包含八個(gè)通道,包括一個(gè)帶低噪聲放大器(LNA)的可變?cè)鲆娣糯笃?/u>(VGA)、一個(gè)具有可編程相位旋轉(zhuǎn)功能的連續(xù)波(CW)諧波抑制I/Q解調(diào)器、一個(gè)抗混疊濾波器(AAF)、一個(gè)14位ADC、一個(gè)用于數(shù)據(jù)處理和帶寬降低的數(shù)字解調(diào)器和抽取器,以及JESD204B接口。圖2是AD9671的功能框圖。
圖2.AD9671功能框圖
數(shù)字解調(diào)器
數(shù)字解調(diào)器由基帶解調(diào)器和基帶抽取器組成。解調(diào)器將RF信號(hào)下變頻為基帶正交信號(hào)。抽取器減少了多余的過采樣。圖3是數(shù)字解調(diào)器的框圖。
圖3.數(shù)字解調(diào)器框圖。
JESD204B接口
AD9671數(shù)字輸出符合JEDEC標(biāo)準(zhǔn)JESD204B,數(shù)據(jù)轉(zhuǎn)換器串行接口。AD9671支持單通道、雙通道或四通道接口。它可以連接到最大數(shù)據(jù)輸出速率為 5.0 Gbps 的 FPGA。
系統(tǒng)設(shè)計(jì)與應(yīng)用
本節(jié)介紹了AD9671多通道超聲系統(tǒng)的接收電路設(shè)計(jì),并進(jìn)一步分析了使用數(shù)字解調(diào)器和JESD204B接口的優(yōu)勢(shì)。
接收電路設(shè)計(jì)
圖4所示為32通道接收電路模塊原理圖,可用于驗(yàn)證基于AD9671的系統(tǒng)可行性。通過四個(gè)這樣的模塊,可以配置超聲系統(tǒng)的128通道接收電路。該模塊可用于執(zhí)行數(shù)據(jù)采集和處理,并通過專用FMC連接器連接到FPGA來實(shí)現(xiàn)超聲波信號(hào)處理和圖像生成。
圖4.接收電路的頂層原理圖。
數(shù)字解調(diào)器應(yīng)用分析
對(duì)于 128 通道超聲系統(tǒng),如果使用采樣率為 40 MSPS 的 14 位 ADC,并且使用 RF 波束成形算法,則 ADC 輸出和波束成形 FPGA 之間的數(shù)據(jù)速率為 14 × 40 × 128 = 71.68 Gbps。
下面分析了使用數(shù)字解調(diào)器的好處。
RF信號(hào)的基帶解調(diào)器執(zhí)行正交解調(diào)。這可以通過將ADC輸出的數(shù)字化RF信號(hào)乘以復(fù)正弦信號(hào)
來實(shí)現(xiàn),其中fd是可以接近超聲換能器中心頻率的解調(diào)頻率,以將中心頻率下變頻至0 Hz左右。輸出信號(hào)是一個(gè)復(fù)數(shù)信號(hào),由其I(同相)和Q(正交相位)表示。探頭的中心頻率和所有感興趣的頻段信號(hào)被降檔到大約0 Hz,用濾波器和抽取器濾除不需要的頻率分量,以保留對(duì)生成超聲圖像有用的頻段信息。
對(duì)于中心頻率為3.5 MHz的探頭換能器,經(jīng)過基帶解調(diào)和抽取后,具有16位格式I和Q數(shù)據(jù)輸出,數(shù)據(jù)速率現(xiàn)在為2(I&Q)×16位×3.5 MHz×128通道= 14.336 Gbps。 與原來的71.68 Gbps相比,即使I和Q通道同時(shí)輸出,數(shù)據(jù)速率也降低了80%。
JESD204B接口應(yīng)用分析
就當(dāng)前多通道超聲系統(tǒng)應(yīng)用中的AFE和ADC而言,LVDS已經(jīng)取代了并行輸出接口。然而,對(duì)于128通道或更高的超聲系統(tǒng),ADC輸出的大量LVDS線連接仍然是設(shè)計(jì)工程師頭疼的問題。對(duì)于LVDS,當(dāng)前超聲系統(tǒng)中有一個(gè)八進(jìn)制AFE有10對(duì)電線。對(duì)于 128 通道超聲系統(tǒng),需要將 128/8 × 10 = 160 對(duì) LVDS 數(shù)據(jù)和時(shí)鐘線連接到 FPGA。
下面分析了使用JESD204B接口的好處。
由于JESD204B使用16位數(shù)字輸出格式并使用8B/10B編碼,因此具有14位分辨率、40 MSPS ADC的八通道AFE的輸出數(shù)據(jù)速率為20 ×40 × 8 = 6.4 Gbps。AD9671 JESD204B接口每通道的最大數(shù)據(jù)速率為5.0 Gbps,因此只需兩對(duì)數(shù)據(jù)通道即可實(shí)現(xiàn)8通道AFE數(shù)據(jù)輸出。因此,對(duì)于 128 通道超聲系統(tǒng),與 160 對(duì) LVDS 線相比,只需要 128/8 × 2 = 32 對(duì)輸出數(shù)據(jù)通道;消除了 80% 的物理接口路由。
結(jié)論
本文介紹了一種基于AD9671(具有數(shù)字解調(diào)器和JESD204B接口的八通道AFE)的多通道超聲系統(tǒng)設(shè)計(jì)。本文分別有效分析了在超聲系統(tǒng)中使用這種帶有數(shù)字解調(diào)器和JESD204B接口的AFE的應(yīng)用優(yōu)勢(shì)和優(yōu)勢(shì)。與目前大多數(shù)RF波束成形和LVDS接口設(shè)計(jì)相比,模擬前端和數(shù)字處理部分之間的數(shù)據(jù)速率和接口路由都降低了80%。如果在分析中將這兩種方法組合在一起,物理連接將進(jìn)一步減少。因此,本文介紹的系統(tǒng)設(shè)計(jì)可以通過減少數(shù)據(jù)接口布線所需的電路板面積、計(jì)算復(fù)雜性要求以及系統(tǒng)設(shè)計(jì)成本,有效地簡(jiǎn)化電路設(shè)計(jì)和軟件處理復(fù)雜性。
審核編輯:郭婷
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