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月薪5K單片機工程師逆襲2w+:明白這一點,你的人生也能開掛!

潘文明 ? 2022-12-19 10:07 ? 次閱讀

常??吹竭@樣的觀點:

1.只要你夠堅持,總有一天會成功;

2.只要你夠勤奮,月薪過萬很輕松;

3.只要你夠努力,老天一定不會辜負你……

你是不是很認同這樣的說法?

恭喜你,又被忽悠了!

你有沒有想過:明明你很努力,別人卻輕而易舉成功,為什么你卻不能?

你辛苦背一天單詞,合上書就忘光,別人只花1小時就牢記不忘;

你在考前熬夜復(fù)習(xí),最后還是掛科,室友卻輕松穩(wěn)拿高分……

你每天加班累成狗,比你晚來的小強,準時下班卻升為主管;

這個時代,最不缺的就是廉價的勤奮。

其實,我們欠缺的是一種學(xué)習(xí)的捷徑,就是學(xué)習(xí)方法。學(xué)習(xí)方法是學(xué)習(xí)效率的基礎(chǔ),是成功引擎發(fā)動機!

我是一位單片機工程師

我是一名單片機工程師,一次偶然的機會領(lǐng)導(dǎo)讓我參與做 FPGA 項目,從那時起對 FPGA 有著新的認識,想盡辦法學(xué)好它。清晰的記得那天剛接觸 FPGA 是工程師畫的一塊板子有幾處錯誤。老大讓我研究摸索那塊板子,于是我就玩起開發(fā)板。按照網(wǎng)上的資料寫了一個 LED 燈,用 JTAG 下載進去,居然亮了。從此我就看關(guān)注網(wǎng)上 FPGA 的相關(guān)資料,一是熱愛源賴于公司用到 FPGA, 有專門開發(fā) FPGA 工程師。二是想通過學(xué)好 FPGA 項目,提高自己專業(yè)技能,在行業(yè)中能一席之地,不容易被人企業(yè)淘汰,提高競爭力。

理想很豐滿,但現(xiàn)實很骨感……

剛接觸 FPGA 開發(fā)板的時候,就發(fā)覺蠻多問題,總是遇到這樣或那樣的問題,也不知道如何解決是好?其中也很想放棄過,覺得 FPGA 這個行業(yè)不太適合我,因為跟單片機工程師難度大很多, FPGA 工程師邏輯思維推理能力要非常強,才能做好這份工作。比如自己畫 FPGA 板子,用的是 EP4CE22E22 。為了方便焊接選了一個 LQFP 封裝的。結(jié)果錯誤出現(xiàn)了。芯片底下的熱風(fēng)焊盤沒有畫,加上電, FPGA 居然燒了。第一版沒成。第二版。第二版只畫了 JTAG 口,但是 FPGA 與串行 flash 沒有連接。所以 AS 下載的時候總是彈出錯誤,說下載線出錯。郁悶了好久。管腳太多。沒辦法一條一條核對……

后來我遇到了他——我的師兄,改變了我的一生!

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潘文明,暨南大學(xué)通信與信息系統(tǒng)專業(yè)碩士, 在集成電路研究方向上屬學(xué)霸級人物?,F(xiàn)任明德?lián)P科技教育有限公司總經(jīng)理、廣州敏道信息科技有限公司理論研究名譽所長、東莞市瑞航信息科技有限公司高級技術(shù)顧問,主攻FPGA實用型人才培訓(xùn),致力于中國芯片人才培養(yǎng),決心振“芯”中國英才庫。

潘文明先生先后于中國電子科技集團第七研究所和華為海思工作。期間參與了跳頻-OFDM系統(tǒng)、超高速網(wǎng)絡(luò)芯片、工業(yè)以太網(wǎng)相機等大型項目研發(fā),擁有豐富的FPGA、芯片設(shè)計經(jīng)驗。在國內(nèi)一流IT企業(yè)工作期間,他意識到中國芯片領(lǐng)域多數(shù)還停留在應(yīng)用方面,核心技術(shù)也就是芯片開發(fā)方面,與世界一流水平有不小差距,遂立志獻身于芯片教育領(lǐng)域,為中國芯片人才的培養(yǎng)盡拳拳赤子之心。

是在條件優(yōu)渥的環(huán)境中繼續(xù)工作,還是用所學(xué)本領(lǐng)為中國芯片發(fā)展開疆拓土?潘文明用實際行動回答。2013年,他放棄華為海思的再三挽留和高薪待遇,創(chuàng)立明德?lián)P科技教育有限公司?!澳転閲遗囵B(yǎng)世界一流的芯片人才,在祖國做出一些前沿科技的突破,意義完全不同?!迸宋拿鞯榔破渲芯売伞?/span>

在潘文明看來,藍圖再宏偉,也要一步一個腳印走,而這最為關(guān)鍵的第一步,他選擇了從事芯片教育。早在求學(xué)期間,他所作的畢業(yè)論文《DES加密芯片的研制及其實現(xiàn)》問世即受到廣泛關(guān)注,被諸多專業(yè)人士作為文獻參考,如《基于NFC芯片的的防偽溯源系統(tǒng)》《異構(gòu)數(shù)控機床群控系統(tǒng)關(guān)鍵技術(shù)研究及應(yīng)用 》等論文所引用。創(chuàng)辦明德?lián)P科教后,他結(jié)合多年的理論研究和豐富項目實戰(zhàn)經(jīng)驗,總結(jié)提煉出高效簡單實用的《潘氏至簡設(shè)計法》,開發(fā)《點撥FPGA教程》、《至簡設(shè)計法教程》等系列視頻教程,他所編寫出版的系列相關(guān)專業(yè)論文和書籍,具備非常鮮明的深入淺出、專業(yè)實用、語言簡練的特征,深獲業(yè)內(nèi)眾多資深人士認可FPGA學(xué)習(xí)者喜愛。眾多學(xué)員學(xué)習(xí)后進入世界500強企業(yè)工作,更是側(cè)面證實了其實用、高效、易學(xué)、便捷。2017年主創(chuàng)的《手把手教你FPGA設(shè)計-基于大道至簡的至簡設(shè)計法》由北京航天航空出版社出版也獲得廣泛關(guān)注。除此之外,潘文明先生和他的IT精英團隊在芯片教育理論、FPGA理論研究、應(yīng)用技術(shù)創(chuàng)新、項目開發(fā)、計算機軟硬件技術(shù)開發(fā)、系統(tǒng)集成、網(wǎng)絡(luò)技術(shù)開發(fā)、信息技術(shù)咨詢等范圍也取得了一系列優(yōu)異成績。

面對成就,潘文明不忘初心,沒有驕傲自滿止步不前,始終以中國民族芯片業(yè)屹立世界之巔為抱負,率領(lǐng)團隊繼續(xù)在中國芯片教育領(lǐng)域砥礪前行。

他說,這是他一生中最有價值也將繼續(xù)創(chuàng)造價值的工作!

我跟他交流學(xué)習(xí) FPGA 方法、如何做好 FPGA 項目、對新人初學(xué) FPGA 有啥建議等。他在 FPGA領(lǐng)域工作研究好多年,研發(fā)出 “ 明德?lián)P至簡設(shè)計法 ” ,

靠著這套學(xué)習(xí)系統(tǒng)的加持,我的人生一路開掛逆襲,三個月我就可以順利完成公司的FPGA項目。領(lǐng)導(dǎo)對我刮目相看,贊不絕口,升為研發(fā)部主管,薪資直接double+。

我比任何人,都更加堅定不移地相信:學(xué)習(xí)是有捷徑的,掌握好的方法,可以少走彎路。

那么,重點來了!?。⌒率滞瑢W(xué)如何學(xué)好 FPGA呢 ?我將潘老師的建議整理出來給到大家,避免大家少走彎路。

首先,初學(xué)者一開始就要盡快學(xué)完核心知識。

什么是核心知識?就是做任何項目都必須用到的基礎(chǔ)知識,那么什么是核心知識?

1. verilog 。verilog 中時序邏輯和組合邏輯寫法、運算符、企業(yè)設(shè)計規(guī)范、例化方法等就是核心知識;模塊結(jié)構(gòu)、信號類型等是識記內(nèi)容,理解就可以的;function 、 task 、讀寫文件等就純粹沒必要學(xué)了。

2. 測試文件。編寫代碼后,必須對代碼仿真,這個時候就要編寫測試文件了。那么要懂得時鐘和復(fù)位的產(chǎn)生方法、信號產(chǎn)生方法、例化等是核心知識,其他內(nèi)容就沒啥必要的。

3. modelsim。modelsim 是仿真工具,新建工程、編譯工程、解決提示的錯誤、仿真工程、查看波形、定位問題和解決問題等是核心知識,其他工具中更高級的功能真沒必要學(xué)先。

4. quartus。當(dāng)仿真正確后,就要加載工程到板子上跑跑了。quartus 的新建工程、綜合、配置管腳、下載工程等就是核心知識,會這幾步驟就可以了。

5. signaltap。當(dāng)電路上板后,發(fā)現(xiàn)現(xiàn)象不對,此時就需要 signaltap 去查看芯片內(nèi)部發(fā)生了什么事。signaltap 原理、設(shè)置、觸發(fā)條件等設(shè)置就是核心知識。要懂得如何通過 signaltap 去定位問題。

6. 至簡設(shè)計法學(xué)習(xí)。經(jīng)過前面幾步,相信你可以把已有的工程下載到板上看現(xiàn)象了。但你此時還沒能力做設(shè)計,不懂得如何下手。這時要學(xué)習(xí)至簡設(shè)計法。它會教你如何一步一步傻瓜似去完成一個復(fù)雜電路的設(shè)計,里面很多有實用技巧,熟練運用這些技巧,有助于你寫出非常優(yōu)秀的代碼。

盡快掌握以上 6 點知識,你就越快學(xué)好 FPGA ,非核心知識,用到什么學(xué)什么,這是明德?lián)P一貫的學(xué)習(xí)觀點。這些知識只有遇到了,才會有深刻的印象。很多人又說,我都沒項目做,那豈不是不要學(xué)了?幸好潘老師都想到這個情況,把項目中遇到的問題,都提煉成系統(tǒng)的練習(xí)題,供同學(xué)們實訓(xùn),這樣就保證了學(xué)員能夠?qū)W到真正技能,真正的本事了。

掌握至簡設(shè)計法過的是不一樣的人生

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我叫*明,目前在佛山一家公司擔(dān)任FPGA設(shè)計工程師,月薪15k。以前在學(xué)校學(xué)習(xí)時也挺努力的,老師上課我也非常認真聽,認真做筆記。可是也不知道為什么一直到了大三,我還是處于一種很茫然的狀態(tài),就是感覺自己好像什么都會,都懂,但是真的給我一個項目,卻怎么也做不出來。我一度對自己感覺很失望,懷疑自己是不是太笨了,或者FPGA根本不是我的菜。偶爾有一次在網(wǎng)上看到了明德?lián)P的視頻,當(dāng)時靈光一閃,有戲!于是我報名參加了明德?lián)P的就業(yè)培訓(xùn)班,突然感覺像在武俠小說里,有位絕世高手幫我打通了任督二脈!在全實戰(zhàn)項目的學(xué)習(xí)環(huán)境下,僅僅兩個多月,我就掌握了至簡設(shè)計法。最主要的是,這不是一個簡單的接口或者技巧,而是一個適用于所有項目的方法。掌握這種方法,再大的項目也不在話下。我想說的是:明德?lián)P《潘文明至簡設(shè)計法》,真正的絕世武功,讓你笑傲江湖!

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我叫*媛,目前在華為擔(dān)任FPGA設(shè)計工程師,月薪12k。大家看我頭像也知道我是女生啦。大2的時候,當(dāng)我說要學(xué)FPGA時,好多人勸我。有說FPGA太需要邏輯思維,女生不合適;有說FPGA太難,女生學(xué)不會;有說FPGA工程師都是男的,女生學(xué)會了也不一定找得到工作,類似種種不一而足。當(dāng)時只有一位已經(jīng)參加工作了的師哥支持我,他在QQ上告訴我如果你真的決定了學(xué)FPGA,你就去找明德?lián)P。于是我參加了明德?lián)P的就業(yè)班培訓(xùn)。令我最驚喜的是這里就像請了專職家教一樣,在老師一對一輔導(dǎo)下,我完全能獨立地完成設(shè)計項目,順利畢業(yè)了。現(xiàn)在,我已經(jīng)在華為技術(shù)部上班,成為了一名女工程師。偷偷地告訴你們,特別是給師妹們一個秘密:女孩子當(dāng)工程師有個很大的好處,因為女孩子少,咱們在公司可是焦點哦。 我想告訴大家:有了明德?lián)P,F(xiàn)PGA一點也不難!

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我是*強,目前在深圳市邁德視科技有限公司擔(dān)任FPGA工程師,月薪16k。我的叔叔就是這個行業(yè)的,讀大一的時候他就讓我參加培訓(xùn)班,并推薦了明德?lián)P。當(dāng)時我很奇怪覺得應(yīng)該先打基礎(chǔ),再說我在學(xué)校難道學(xué)不會嗎?他只是簡單的說了一句“你別管那么多,聽我的沒錯。”我真正在明德?lián)P網(wǎng)絡(luò)培訓(xùn)班學(xué)習(xí)后才發(fā)現(xiàn),明德?lián)P和學(xué)校的課程區(qū)別太大了。學(xué)校里面基本上都是理論性通用性的,而且大課堂授課形式也不可能說具體深入的內(nèi)容;而明德?lián)P全部都是實用性的,精簡了所有實際中用不到的知識,并且是導(dǎo)師一對一輔導(dǎo)。明德?lián)P的目標很明確:通過培訓(xùn),讓學(xué)員能完全獨立自主地設(shè)計項目。就這樣,大一還沒結(jié)束,我已經(jīng)完全能自己設(shè)計FPGA項目。大二時,叔叔由于太忙,讓我?guī)土藥讉€項目。在明德?lián)P老師的跟蹤輔導(dǎo)下,一個項目之后,我已經(jīng)可以駕輕就熟地完成剩下的了。當(dāng)我把項目設(shè)計交給叔叔時,他笑瞇瞇地說要給我卡上轉(zhuǎn)一筆錢,并告訴我這是我自己的勞動所得。之后,在學(xué)校時還斷斷續(xù)續(xù)做了一些項目。可以說,我的學(xué)費和生活費此后都沒讓家里操過心。最重要的是,大學(xué)畢業(yè)時,我已經(jīng)是一個有豐富經(jīng)驗的FPGA工程師,我需要做的不是去找工作,而是去選工作。我想說的是,來明德?lián)P學(xué)習(xí)FPGA,學(xué)的越早越好,別耽誤自己的時間!

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我叫*逐濤,目前在蘇州欣華銳電子有限公司擔(dān)任FPGA工程師,月薪14k。以前在深圳一家企業(yè)做硬件工程師,上了兩三年班,盡管我非常努力,公司也給我漲過工資,不過還是不太滿意。我了解了一下具體的行業(yè)薪資行情,發(fā)現(xiàn)硬件工程師月薪也就跟自己的差不多了,沒什么上升空間;但是,F(xiàn)PGA工程師工資倒是挺高的。開始我采用自學(xué)的方式摸索了大半年的時間,卻完全掌握不到要領(lǐng),心想怪不得FPGA工程師工資高,原來因為太難了。后來,朋友給我推薦了明德?lián)P,而且明德?lián)P開有周末班,于是我就報名參加了。潘老師的授課內(nèi)容全部都是我以前苦思不得其解的內(nèi)容。原來FPGA竟然這么簡單!很快地,我就從明德?lián)P畢業(yè),現(xiàn)在如愿以償?shù)刈隽薋PGA設(shè)計工程師,也得到了理想的薪金。 我想告訴大家:來明德?lián)P學(xué)FPGA,又快又好,不要再猶豫了。

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我叫*智,目前在AMD擔(dān)任FPGA工程師,月薪19k。說起來,我來明德?lián)P是因為一次“賭局”。從事過FPGA設(shè)計過的朋友都知道,仿真和調(diào)試工作是非常繁瑣和耗時的,不過習(xí)以為常也就無所謂了。有一次一個大學(xué)同學(xué)來看我,當(dāng)時我正在加班,就是在仿真和調(diào)試。我說我快搞完了,再等一下。他在旁邊看了一會就笑我說,你這么做不累嗎?這個項目根本不要仿真調(diào)試的。大學(xué)時他真的不如我,何況在我們公司大家都是這么做的,0仿真0調(diào)試可能嗎?我當(dāng)然不信了,兩人就打起賭來了。結(jié)果我同學(xué)指了幾個地方,說如果代碼是怎么怎么寫,就不存在哪里哪里的仿真調(diào)整有問題。我仔細一看心里驚叫:天??!幾天不見,他怎么脫胎換骨了!是的,我賭輸了。不過,這場賭博我這個輸家卻是贏得最多的,因為從同學(xué)口里我知道了明德?lián)P,知道了潘文明至簡設(shè)計法。三個月后,我從明德?lián)P就業(yè)班畢業(yè)了。作為公司設(shè)計團隊里唯一一個設(shè)計項目0仿真0調(diào)試的設(shè)計師,我受到了公司的高度重視,工資也從原來的10k調(diào)到了現(xiàn)在的19k。我想說的是:來明德?lián)P,高級講師帶你飛,從菜鳥直達技術(shù)大牛!

列舉不完的案例…………

10000+名學(xué)員驗證有效的實用方法

初學(xué)者、有經(jīng)驗的工程師都適用

FPGA/ASIC邏輯設(shè)計高手修煉課

本課程的教學(xué)目標:

通過教授至簡設(shè)計法技巧,解決不會設(shè)計,無思路,無規(guī)范,無邏輯的問題,并通過專項訓(xùn)練的方式,提高和訓(xùn)練FPGA和ASIC的代碼設(shè)計能力。

2

FPGA/ASIC實用調(diào)試技巧培訓(xùn)教程

本課程的教學(xué)目標:

通過明德?lián)P的定位問題的方法,解決大家在仿真和調(diào)試時遇到問題慌亂無助的問題。教大家一個“任何問題都能找到”的定位問題方法和思路,并通過多個案例,掌握定位問題和解決問題的最佳方法。

3

FPGA架構(gòu)師之FIFO架構(gòu)設(shè)計培訓(xùn)教程

本課程的教學(xué)目標:

通過教授明德?lián)PFIFO架構(gòu)設(shè)計八步法,并輔以實訓(xùn)題,幫助大家快速掌握FIFO設(shè)計方法,快速成為FPGA架構(gòu)師。

4

項目實踐:溫度檢測綜合工程

本課程是FPGA學(xué)習(xí)進階的第一個項目工程,通過本工程,您將可以學(xué)到:

1. 將至簡設(shè)計法運用到項目的能力

2. 初步的架構(gòu)設(shè)計和模塊劃分技巧

3. 上位機和FPGA的交互命令架構(gòu)

4. 體驗真實項目中的設(shè)計、仿真和調(diào)試過程

5. 為接下來的的更大更復(fù)雜項目打下基礎(chǔ)

5

項目實踐:邊緣檢測綜合工程

本課程是FPGA學(xué)習(xí)進階的第二個項目工程,通過本工程,您將可以學(xué)到:

1. 將至簡設(shè)計法運用到項目的能力

2. 初步的架構(gòu)設(shè)計和模塊劃分技巧

3. 高斯濾波、SOBEL等圖像算法的實現(xiàn)

4. 為接下來的的更大更復(fù)雜項目打下基礎(chǔ)

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項目實踐:千兆網(wǎng)綜合工程

本課程是FPGA學(xué)習(xí)進階的第三個項目工程,通過本工程,您將可以學(xué)到:

1. 將至簡設(shè)計法運用到項目的能力

2. 初步的架構(gòu)設(shè)計和模塊劃分技巧

3. UDP、ARP等網(wǎng)絡(luò)協(xié)議與實現(xiàn)

4. 千兆網(wǎng)等調(diào)整接口

5. FIFO的熟練應(yīng)用

6. 為接下來的的綜合性課程或項目打下堅實基礎(chǔ)

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    發(fā)表于 03-22 15:47

    【V4.5華秋DFM】這一次,我們想用工程師的語言對話

    分析 。但比數(shù)字更重要的是:每次更新都源自產(chǎn)線上的真實痛,每次優(yōu)化都在縮短設(shè)計與制造的距離。 工程師的深夜咖啡會涼,但好工具應(yīng)該越用越趁手。我們還有更多的優(yōu)化細節(jié)在等你親自發(fā)現(xiàn),
    發(fā)表于 02-13 11:49

    月薪 3 萬的嵌入式工程師都在用,串口屏到底神在哪?

    作為名資深的嵌入式工程師,我深知在選擇硬件組件時,性能、可靠性、易用性和成本效益都是至關(guān)重要的考量因素。月薪3萬的嵌入式工程師們之所以傾向于使用串口屏,主要是基于以下幾個方面的考量
    的頭像 發(fā)表于 02-12 10:33 ?614次閱讀
    <b class='flag-5'>月薪</b> 3 萬的嵌入式<b class='flag-5'>工程師</b>都在用,串口屏到底神在哪?

    為什么嵌入式驅(qū)動開發(fā)工程師可以拿高薪?

    計算等技術(shù)的發(fā)展不斷擴增,推動著用人崗位的激增,其中超85%的崗位薪資超10000元/月。 據(jù)職友集統(tǒng)計,近61.7%的嵌入式驅(qū)動開發(fā)工程師月薪在15~30K區(qū)間,20
    發(fā)表于 01-07 16:56

    硬件工程師面試基礎(chǔ)知識

    、晶振電路 大多數(shù)電子工程師都見過單片機中如下圖所示的形式,單片機都會有這樣的電路。晶振的兩個引腳與芯片(如
    的頭像 發(fā)表于 11-21 11:04 ?695次閱讀
    硬件<b class='flag-5'>工程師</b>面試基礎(chǔ)知識<b class='flag-5'>點</b>

    需要設(shè)計個10~5K的信號的積分電路,信號達到5K的方波輸入的時候,輸出信號電平轉(zhuǎn)換帶有尖脈沖,為什么?

    我現(xiàn)在需要設(shè)計個10~5K的信號的積分電路,就是用常見電路搭建,現(xiàn)在問題是在滿足10HZ以后的積分電路后,當(dāng)信號達到5K的方波輸入的時候,輸出信號電平轉(zhuǎn)換帶有尖脈沖。如圖。 誰能解釋下原因,怎么消除這個現(xiàn)象。
    發(fā)表于 08-28 07:04

    不按INTEL的“3W-2S”規(guī)則設(shè)計,出問題的概率有多大?

    中找到個平衡吧! OK,最后我們再來對比下大家更為熟悉的眼圖的結(jié)果。我們分別在這4個case的走線中去跑25Gbps速率的碼型,從眼圖的結(jié)果能看到這一點。不補償眼圖明顯差很多這個不用懷疑,三種
    發(fā)表于 08-26 14:51

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