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明明設(shè)計(jì)的是高帶寬,差點(diǎn)加工成開路

edadoc ? 來源:edadoc ? 作者:edadoc ? 2022-06-30 10:33 ? 次閱讀

作者:一博科技高速先生成員 黃剛

有沒有感覺最近只看到了東哥的文章,是不是一度以為我們**了呢。沒有啦,在這里還是要鄭重的和廣大的粉絲們解釋下,高速先生這段時(shí)間一直在積累一些很有趣的素材,學(xué)習(xí)一些新的技術(shù),以便給大家看到更多富有啟發(fā)性的文章,這不我們又來了嗎!

說回正題哈,作為我們高速先生的主業(yè)也就是SI,其實(shí)一直以來我們都很關(guān)心設(shè)計(jì)和加工出來的差異,尤其對于高速信號來說,高速先生只有在加工誤差比較小的情況下,才能去很好的完成一些仿真和測試的擬合。剛好高速先生正在研究一些適合112G的超高寬帶傳輸?shù)脑O(shè)計(jì),PCB設(shè)計(jì)完加工回來后,高速先生立馬投入到了緊張的測試中,結(jié)果就有了本文開頭那一幕的感慨。。。

當(dāng)我們測試到一對帶1.85同軸連接器的內(nèi)層走線時(shí),測出了讓我們意想不到的結(jié)果。設(shè)計(jì)就是一對差分線,我們主要是看看一款高速板材的損耗和加上同軸連接器后,鏈路的帶寬和線性度能去到多高頻率。

我們首先關(guān)注下同軸連接器位置的阻抗和差分線的阻抗,第一反應(yīng),感覺還是不錯(cuò)的,尤其是走線,整個(gè)鏈路的阻抗都在±5%以內(nèi),雖然不能算特別優(yōu)秀,但是心理至少能接受的那種。

然而當(dāng)我們測到插損曲線的時(shí)候,整個(gè)人都不好了,這啥啊這,居然平平無奇的一對差分走線會有那么大的諧振點(diǎn),在28GHz的位置就和開路沒什么兩樣啦!

于是我們首先懷疑的是設(shè)計(jì),看看是不是在PCB設(shè)計(jì)上犯了一些很低級的錯(cuò)誤,結(jié)果查了設(shè)計(jì)文件,壓根就沒問題嘛,線寬線距,等長都沒問題??!

這就奇怪了,一開始高速先生是懷疑是不是漏了背鉆,因此畢竟是3mm的板子,我們這對差分線走到了很靠上的層,但是從差分的TDR阻抗就已經(jīng)排除了我們的想法,因?yàn)槿溌飞隙紱]有一些很低的阻抗點(diǎn),如果是漏背鉆的話,肯定會在阻抗上看出問題的!

那到底是什么問題呢?于是我們把重點(diǎn)放在差分線P和N單端延時(shí)差的問題,于是我們把這對差分的P和N分別給一個(gè)階躍信號,來從時(shí)域上看看它們的延時(shí)到底有沒有差別。結(jié)果讓高速先生大跌眼鏡,P和N之間的延時(shí)差居然有0.17?不對,1.7?也不對,是17.5ps!?。?/span>

如果你對ps這個(gè)單位沒什么概念的話,高速先生轉(zhuǎn)成mil你就知道有多夸張了,就是大概100mil的長度差,也就是說,設(shè)計(jì)上是完全等長的兩根線,加工出來居然有100mil的長度差,最關(guān)鍵的是走線長度還不到3inch。

通過上面的測試和分析,其實(shí)高速先生大概率想到了是玻纖效應(yīng)影響造成的,具體什么是玻纖效應(yīng),就不在這里展開了,可以翻看之前很多期的文章都有提到哈。于是我們把板子拿到板廠做了下切片,以便更好的和我們的預(yù)想貼合。不一會,切片圖就出來了,果然,就是這個(gè)問題了。

可能有部分的粉絲沒看過PCB切片圖,其實(shí)就是在和走線垂直的剖面切開,用高倍顯微鏡來看切面的畫面。就像本文的這張切片圖一樣,可以看到差分走線剛好一根走在了玻纖的交疊區(qū)域(右),另外一根走線窗口處(左),而且不知道算是多大分之一概率的機(jī)會,上下都各有兩張pp(core也是兩張pp組成),而且pp也還是扁平布的情況下,依然無法阻擋差分的P和N處于比較一致的狀態(tài)。另外只要是知道了玻璃布和膠的介電常數(shù)差異,你就會明白這種情況有多嚴(yán)重了。

要不就這樣結(jié)尾了,高速先生已經(jīng)哭倒在實(shí)驗(yàn)室了。。。

問題來了

從設(shè)計(jì)到加工環(huán)節(jié),大家覺得有什么細(xì)節(jié)的方法可以改善玻纖效應(yīng)嗎?

審核編輯:符乾江

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