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動態(tài)更改UltraScale/UltraScale+ GTH/GTY收發(fā)器線速率設置的方法

YCqV_FPGA_EETre ? 來源:FPGA開發(fā)圈 ? 2020-09-03 10:04 ? 次閱讀

本篇博文主要講解了動態(tài)更改 UltraScale/UltraScale+ GTH/GTY 收發(fā)器線速率設置的方法。

您是否曾想過要使用 UltraScale/UltraScale+ GTH/GTY 收發(fā)器來動態(tài)更改線速率設置?

有許多客戶會將 GTH/GTY 收發(fā)器用于其自己的通信協(xié)議,因此詢問我們?nèi)绾尾拍苁褂檬瞻l(fā)器來更改線速率。

在 Vivado IP Catalog 的 UltraScale FPGAs TransceiversWizard 中僅含一項線速率設置。

由于 UltraScale/UltraScale+ GTH/GTYTransceiver Wizard 不允許更改線速率設置,因此必須由收發(fā)器用戶手動執(zhí)行更改。

1.如何通過 DRP 接口更改線速率

(a) 生成收發(fā)器 IP

使用要實現(xiàn)的線速率配置生成收發(fā)器 IP。

(b) 生成設計樣本

(c) 對設計樣本執(zhí)行邏輯綜合

單擊 Flow Navigator 中的“運行綜合 (Run Synthesis)”:

綜合完成后,選擇“打開已綜合的設計 (Open Synthesized Design)”以打開網(wǎng)表。

(d) 運行隨附的腳本

在 Tcl 控制臺 (Tcl console) 中運行g(shù)t_Attributes_97.tcl腳本:

執(zhí)行此腳本即可將“Channel/Common”屬性輸出到gtParams.txt文件。

并且,GTH/GTY 中的屬性和修復后的 GTH/GTY 端口也都將包含在同一個文件中輸出,以便于您進行比較。

針對要實現(xiàn)的每項 GTH/GTY 配置重復上述步驟 (a) 到 (d)。

(e) 比較輸出

通過比較來自 GTH/GTY 配置的gtParams.txt輸出,即可立即查看不同的屬性。

(f) 動態(tài)重配置端口接口 (DRP I/F)

所需屬性必須通過 DRP I/F 來設置。

在 (UG576)/(UG578) 的附錄 B/C 中詳列了每個屬性的地址。

如果您不熟悉 DRP I/F,請參閱 (UG576)/(UG578) 的第 2 章,以獲取更多信息

(g) 復位

在 DRP I/F 上設置完屬性后,必須先再次執(zhí)行復位,然后才能使用 GTH/GTY。

注:建議最好使用此腳本生成gtParams.txt,然后再進行比較,而不是直接比較封裝器 RTL。

由于除 Channel 和 Common 屬性外,還可比較修復后的外部端口,因此您可放心更改這些屬性。

2.更改 CPLL 校準模塊的設置

如果在設計中使用了 CPLL,那么必須在 CPLL 校準模塊中更改信號

請參閱(賽靈思答復記錄 70485),以獲取有關(guān)更改信號所需的設置更改的信息

【答復記錄70485,https://china.xilinx.com/support/answers/70485.html】

綜上,如需動態(tài)更改UltraScale/UltraScale+ GTH/GTY 的線速率,請遵循上述步驟 (1) 和 (2) 進行操作。

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原文標題:開發(fā)者分享 | 如何動態(tài)更改 UltraScale/UltraScale+ GTH/GTY 線速率

文章出處:【微信號:FPGA-EETrend,微信公眾號:FPGA開發(fā)圈】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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