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Allegro操作技巧你值得一學(xué)

PCB線(xiàn)路板打樣 ? 來(lái)源:pcb論壇網(wǎng) ? 作者:pcb論壇網(wǎng) ? 2020-03-03 16:50 ? 次閱讀

Cadence Allegro是目前的主流PCB設(shè)計(jì)軟件之一,具有功能集成化、功能組件化、電路分析功能強(qiáng)大、支持團(tuán)隊(duì)合作等特點(diǎn)。作為一名PCB工程師/硬件工程師,熟練掌握和運(yùn)用Allegro是必備的技能。下面板兒妹和大家分享一些關(guān)于A(yíng)llegro軟件的操作技巧,無(wú)論是新手還是老司機(jī)都應(yīng)該要知道噢。

1、鼠標(biāo)設(shè)定:在A(yíng)llegro視窗 layout時(shí),每執(zhí)行一個(gè)指令例:Add connect, Show element等鼠標(biāo)會(huì)跳到option窗口,這樣對(duì)layout造成不便。

控制面版>滑鼠之移動(dòng)選項(xiàng)中,指到預(yù)設(shè)按鈕(或智慧型移動(dòng)):取消“在對(duì)話(huà)方塊將滑鼠指標(biāo)移到預(yù)設(shè)按鈕”設(shè)置。

2、Allegro布局基本知識(shí)

a、擺放的方法:Edit –》 move或mirror或rotate

b、關(guān)于電容濾波,當(dāng)有大電容和小電容同時(shí)對(duì)一點(diǎn)濾波時(shí),應(yīng)該把從小電容拉出的線(xiàn)接到器件管腳。即靠近管腳的為最小的電容。

c、各層顏色設(shè)置:top –》 粉色;bottom –》 藍(lán)色

3、查看線(xiàn)寬

Display----Element(右邊Find里面只勾選Cline Segs),然后點(diǎn)擊走線(xiàn),在彈出的信息里面可以看到 width 信息。

4、查看線(xiàn)長(zhǎng)

Display----Element(右邊Find里面只勾選Cline),然后點(diǎn)擊走線(xiàn),在彈出的信息里面可以看到 CLINE length 信息。

5、Hilight時(shí)的兩種不同的顯示方式(實(shí)線(xiàn)和虛線(xiàn))

在setup》user preferences》display中,勾上display_nohilitefont,則以實(shí)線(xiàn)顯示,不勾則虛線(xiàn)顯示,實(shí)線(xiàn)比較容易看清。

6、顯示過(guò)孔焊盤(pán)輪廓

Setup-》DesignParameters點(diǎn)擊Display欄,選中右邊的Display planted holes。

7、當(dāng)我們要RENAME背面元件時(shí)不成功

選Edit/property,選中背面所有元件(FIND中選component),分配一個(gè)auto_rename屬性,然后再rename一次。

8、定義某部分區(qū)域不能有測(cè)試點(diǎn)

在ManuFATuring/no_probe_bottom這層加上一塊SHAPE則可。當(dāng)用Route/Testprep/create Probe來(lái)create這塊區(qū)域的測(cè)試點(diǎn)時(shí)會(huì)失敗,出現(xiàn)的提示為:Pin out of bounds。

9、CRTL鍵在A(yíng)llegro中的使用。

在執(zhí)行逐個(gè)多選指令像Hilight、其他命令之Temp Group時(shí),按住CRTL鍵可以實(shí)現(xiàn)反向選擇的功能,即執(zhí)行Hilight時(shí),按CRTL鍵時(shí)為Dehilight, 執(zhí)行其他命令之Temp Group時(shí)按CRTL鍵為取消選擇。

10、 Allegro 如何關(guān)閉鋪銅(覆銅)shape的顯示

Allegro 的shape 默認(rèn)顯示模式是通過(guò) 菜單 “Setup” -》 “User Preferences…” ,然后在彈出的 “?User Preferences Editor” ?用戶(hù)配置窗口中選擇 “Display” 選項(xiàng)下的 “shape_fill”, 勾選對(duì)應(yīng)的選項(xiàng)即可實(shí)現(xiàn) 禁止鋪銅顯示還是顯示鋪銅邊框功能。

11、更新封裝

封裝修改后,在allegro下palce--update symbols。在package symbol下選擇要更新的封裝。

注意勾選? update symbol padstacks、Ignore FIXED property。

12、約束規(guī)則的設(shè)置概要

a)約束的設(shè)置:setup –》 constrains –》 set standard values 可以設(shè)置線(xiàn)寬,線(xiàn)間距。間距包括:pin to pin、line to pin、line to line等

b)主要用spacing rule set 和 physical rule set

13、如何保護(hù)自己的Project。

Allegro14.2中Allegro Design Expert之Editor. File》Properties選擇Password. 輸入密碼,再鉤選Disable export of design data項(xiàng),這樣你的Project就不會(huì)被人盜用了。

14、如何替換某個(gè)過(guò)孔?如何不在布線(xiàn)狀態(tài)下快速添加過(guò)孔?

Tools-》PadStack-》Replace,然后必須選上Single via replace mode,最后選上要想替換的過(guò)孔即可;

利用copy來(lái)快速添加大量過(guò)孔即可。

15、LLEGRO 如何生成鉆孔文件

Manufacture -》 NC -》 Drill Customization-》auto generate symbols

Manufacture -》 NC -》 Drill Legend

Manufacture -》 NC -》NC parameters-》enhanced excellon format-》close

Manufacture -》 NC -》 NC Drill-》auto tool select-》optimize drill head travel

責(zé)任編輯:ct

聲明:本文內(nèi)容及配圖由入駐作者撰寫(xiě)或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀(guān)點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場(chǎng)。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問(wèn)題,請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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