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電子發(fā)燒友網(wǎng)>制造/封裝>PCB制造相關(guān)>板級電路多信號模型自測試技術(shù)

板級電路多信號模型自測試技術(shù)

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2018-09-10 16:28:17

高速電路PCB設(shè)計(jì)技巧

高速電路PCB設(shè)計(jì)技巧改進(jìn)電路設(shè)計(jì)規(guī)程提高可測試性隨著微型化程度不斷提高,元件和布線技術(shù)也取得巨大發(fā)展,例如BGA外殼封裝的高集成度的微型IC,以及導(dǎo)體之間的絕緣間距縮小到0.5mm,這些僅是
2009-05-16 20:41:11

高速互連SPICE仿真模型完成電路分析

上,主要應(yīng)用于集成電路的設(shè)計(jì)。而MicroSim公司(后來被OrCAD公司兼并,而OrCAD又被Cadence公司兼并)開發(fā)的PSPICE運(yùn)行于PC上,主要應(yīng)用于PCB和系統(tǒng)的設(shè)計(jì)。  SPICE
2018-08-31 14:55:27

電工技術(shù)(電工學(xué)I)典型題解析及自測試

電工技術(shù)(電工學(xué)I)典型題解析及自測試題是根據(jù)國家教育部(前國家教委)1995年修訂的“高等工業(yè)學(xué)校電工技術(shù)(電工學(xué)Ⅰ)課程教學(xué)基本要求“編寫的學(xué)習(xí)指導(dǎo)書,主要內(nèi)容是
2008-09-20 21:46:120

用內(nèi)建自測試(BIST)方法測試IP核

        近幾年基于預(yù)定制模塊IP(Intellectual Property)核的SoC(片上系統(tǒng))技術(shù)得到快速發(fā)展,各種功能的IP 核可以集成在一塊芯片上,從而使得SoC 的測試、IP 核的
2009-09-09 08:33:4124

嵌入式存儲器內(nèi)建自測試的一種新型應(yīng)用

嵌入式存儲器內(nèi)建自測試的一種新型應(yīng)用孫華義 鄭學(xué)仁 閭曉晨王頌輝吳焯焰 華南理工大學(xué)微電子研究所廣州 510640摘要:當(dāng)今,嵌入式存儲器在SoC 芯片面積中所占的比例越來
2009-12-20 09:26:1138

工業(yè)設(shè)備設(shè)計(jì)中的電子校準(zhǔn)和生產(chǎn)誤差修正方法

本設(shè)計(jì)指南探討了信號調(diào)理、調(diào)整和校準(zhǔn)電路,用于修正系統(tǒng)誤差,從而以合理的成本確保工業(yè)設(shè)備安全、精確。校準(zhǔn)部分討論了利用最終測試補(bǔ)償元件誤差,通過上電自測試和連
2010-07-30 11:34:328

8位RISC_CPU可測性設(shè)計(jì)

本文介紹了一款RISC_CPU的可測性設(shè)計(jì),為了提高芯片的可測性,采用了掃描設(shè)計(jì)和存儲器內(nèi)建自測試,這些技術(shù)的使用為該芯片提供了方便可靠的測試方案。
2010-07-30 17:19:5120

高速互連自測試技術(shù)的原理與實(shí)現(xiàn)

芯片間的互連速率已經(jīng)達(dá)到GHz量級,相比較于低速互連,高速互連的測試遇到了新的挑戰(zhàn)。本文探討了高速互連測試的難點(diǎn),傳統(tǒng)互連測試方法的不足,進(jìn)而介紹了互連內(nèi)建自測試(I
2010-07-31 17:00:1615

Flash存儲器的內(nèi)建自測試設(shè)計(jì)

內(nèi)建自測試是一種有效的測試存儲器的方法。分析了NOR型flash存儲器的故障模型測試存儲器的測試算法,在此基礎(chǔ)上,設(shè)計(jì)了flash存儲器的內(nèi)建自測試控制器??刂破鞑捎昧艘环N23
2010-07-31 17:08:5435

混合型電路的內(nèi)裝式自測試(BIST)結(jié)構(gòu)

隨著超大規(guī)模集成電路(VLSI)制造密度的提高.使得電子電路和系統(tǒng)變得日益復(fù)雜.也顯著地拉加了模擬和數(shù)字集成電路充分測試的難度.另外.市場競爭的壓力對集成電路(Ic)的-惻試
2010-08-06 15:53:2939

基于BIST的編譯碼器IP核測試

介紹了用于IP核測試的內(nèi)建自測試方法(BIST)和面向測試的IP核設(shè)計(jì)方法,指出基于IP核的系統(tǒng)芯片(SOC) 的測試、驗(yàn)證以及相關(guān)性測試具有較大難度,傳統(tǒng)的測試和驗(yàn)證方法均難以滿足
2010-12-13 17:09:1110

基于LFSR優(yōu)化的BIST低功耗設(shè)計(jì)

在BIST(內(nèi)建自測試)過程中,線性反饋移位寄存器作為測試矢量生成器,為保障故障覆蓋率,會產(chǎn)生很長的測試矢量,從而消耗了大量功耗。在分析BIST結(jié)構(gòu)和功耗模型的基礎(chǔ)上,針
2010-12-23 15:35:110

±50g自測試電路

±50g自測試電路
2009-07-03 12:03:06411

NAC-201具有自測試電路

NAC-201具有自測試電路
2009-07-03 13:09:10409

NAC-206具有自測試電路

NAC-206具有自測試電路
2009-07-03 13:09:35478

工業(yè)設(shè)備設(shè)計(jì)中的電子校準(zhǔn)和生產(chǎn)誤差修正方法

本設(shè)計(jì)指南探討了信號調(diào)理、調(diào)整和校準(zhǔn)電路,用于修正系統(tǒng)誤差,從而以合理的成本確保工業(yè)設(shè)備安全、精確。校準(zhǔn)部分討論了利用最終測試補(bǔ)償元件誤差,通過上電自測試和連
2010-07-24 12:08:27626

工業(yè)設(shè)備設(shè)計(jì)中的電子校準(zhǔn)和生產(chǎn)誤差修正

本設(shè)計(jì)指南探討了信號調(diào)理、調(diào)整和校準(zhǔn)電路,用于修正系統(tǒng)誤差,從而以合理的成本確保工業(yè)設(shè)備安全、精確。校準(zhǔn)部分討論了利用最終測試補(bǔ)償元件誤差,通過上電自測試和連
2010-07-27 18:09:20693

基于掃描的電路設(shè)計(jì)

通常我們在設(shè)計(jì)芯片的同時,可以根據(jù)芯片本身的特征,額外地把可測性電路設(shè)計(jì)(Design For Testability)在芯片里。談到可測性的電路設(shè)計(jì),內(nèi)建自測試(BIST)和基于掃描Scan—Based)的電路設(shè)計(jì)
2011-06-10 10:13:452157

大規(guī)模集成電路可測性設(shè)計(jì)及其應(yīng)用策略

隨著集成電路的規(guī)模不斷增大,集成電路的可測性設(shè)計(jì)正變得越來越重要.綜述了可測性設(shè)計(jì)方案掃描通路法、內(nèi)建自測試法和邊界掃描法,并分析比較了這幾種設(shè)計(jì)方案各自的特點(diǎn)及應(yīng)
2011-10-28 17:28:5146

低功耗測試矢量生成技術(shù)的研究

在集成電路內(nèi)建自測試的過程中,電路測試功耗通常顯著高于正常模式產(chǎn)生的功耗,因此低功耗內(nèi)建自測試技術(shù)已成為當(dāng)前的一個研究熱點(diǎn)。為了減少被測電路內(nèi)部節(jié)點(diǎn)的開關(guān)翻轉(zhuǎn)活
2012-02-01 14:00:3621

usb口轉(zhuǎn)串口的驅(qū)動

usb口轉(zhuǎn)串口的驅(qū)動,本人親自測試通過,請放心使用
2015-11-10 17:06:5624

J8升級20140610zjb

本人親自測試的Jlink刷機(jī)教程,很有含量哦
2015-11-06 16:56:3815

XDS100V3原理圖(自己重新畫的)

XDS100V3原理圖,是按照官方的原理圖重新畫的,親自測試通過。
2015-12-02 10:22:11157

msp430 溫度控制系統(tǒng)

溫度控制系統(tǒng),親自測試,可以使用,十分強(qiáng)大,感興趣的可以看看。
2016-07-22 16:53:460

一種基于包的邏輯內(nèi)置自測試電路設(shè)計(jì)方法

一種基于包的邏輯內(nèi)置自測試電路設(shè)計(jì)方法
2017-02-07 16:14:5612

運(yùn)算放大器測試基礎(chǔ)第3部分:適用于運(yùn)算放大器測試電路配置

在本系列的第 1 部分中,我們?yōu)榇蠹医榻B了三種運(yùn)算放大器測試電路自測試電路、雙運(yùn)算放大器環(huán)路以及三運(yùn)算放大器環(huán)路。這些電路有助于測試失調(diào)電壓 (VOS)、共模抑制比 (CMRR)、電源抑制
2017-04-08 06:06:344888

TMS570LS系列微控制器配置與可編程內(nèi)置自測試的概述

TMS570LS系列微控制器與可編程內(nèi)置自測試(pbist)實(shí)現(xiàn)建筑。的pbist架構(gòu)提供了一種存儲器BIST引擎不同的覆蓋水平在許多嵌入式內(nèi)存實(shí)例中。TMS570LS系列微控制器可分為兩類:130
2018-04-16 16:03:3812

利用EDA技術(shù)在FPGA芯片上實(shí)現(xiàn)了準(zhǔn)單輸入調(diào)變序列生成器的設(shè)計(jì)

隨著集成電路復(fù)雜度越來越高,測試開銷在電路和系統(tǒng)總開銷中所占的比例不斷上升,測試方法的研究顯得非常突出。目前在測試源的劃分上可以采用內(nèi)建自測試或片外測試。
2019-04-26 09:12:001030

新的平衡電流模式模擬電路自測試方法的片上解決方案詳細(xì)說明

仿真結(jié)果:為了評價(jià)BIC監(jiān)測儀用于新型并行模擬自測試的可行性,進(jìn)行了故障仿真。全差分電流傳送器被用作被測器件。在監(jiān)視通過/失敗輸出(圖2)的同時,將每個典型的MOS晶體管的終端故障(短路和開路)分別
2019-11-26 16:36:300

VLSI測試與可測試性設(shè)計(jì)的學(xué)習(xí)課件資料合集

VLSI測試技術(shù)導(dǎo)論, 可測試性設(shè)計(jì), 邏輯與故障模擬,測試生成,邏輯自測試,測試壓縮,邏輯電路故障診斷,存儲器測試與BIST,存儲器診斷與BISR,邊界掃描與SOC測試,納米電路測試技術(shù),復(fù)習(xí)及習(xí)題
2020-10-09 08:00:001

開關(guān)電源(Buck電路)的小信號模型及環(huán)路設(shè)計(jì)

開關(guān)電源(Buck電路)的小信號模型及環(huán)路設(shè)計(jì)(實(shí)用電源技術(shù)答案)-開關(guān)電源(Buck電路)的小信號模型及環(huán)路設(shè)計(jì)???????????
2021-09-18 10:03:1278

運(yùn)算放大器測試基礎(chǔ)第4部分:測試運(yùn)算放大器需要穩(wěn)定的測試環(huán)路

糕的是,您可能很晚才發(fā)現(xiàn),而此時糾正該問題已經(jīng)更難了。 自測試補(bǔ)償 以最簡單的形式看,圖 1 中的自測試電路實(shí)際上是一款增益為 1201 的閉環(huán)系統(tǒng)。如果將 R1 減小至 5kW,閉環(huán)增益就是 301。因此,它具有固有的穩(wěn)定性,即使采用未
2021-11-23 17:46:331648

運(yùn)算放大器測試基礎(chǔ)第3部分:可配置電路測試運(yùn)算放大器

作者:Martin Rowe — 2011 年 11 月 16 日 在本系列的第 1 部分中,我們?yōu)榇蠹医榻B了三種運(yùn)算放大器測試電路自測試電路、雙運(yùn)算放大器環(huán)路以及三運(yùn)算放大器環(huán)路。這些電路
2021-11-23 17:41:501456

關(guān)于芯片設(shè)計(jì)的前端設(shè)計(jì)實(shí)現(xiàn)

LBIST (Logic build-in-self test), 邏輯內(nèi)建自測試。和MBIST同理,在關(guān)鍵邏輯上加上自測試電路,看看邏輯cell有沒有工作正常。BIST總歸會在芯片里加入自測試邏輯,都是成本。
2022-08-29 15:33:302266

一文解析NMOS管的大信號模型和小信號模型

NMOS管,其電路模型可分為大信號模型和小信號模型。
2022-10-14 13:04:135835

UM2986 STM32U5系列IEC 60730自測試庫用戶指南

UM2986 STM32U5系列IEC 60730自測試庫用戶指南
2022-11-22 08:21:450

信號模型和小信號模型的區(qū)別

信號模型和小信號模型是電子工程和通信領(lǐng)域中常用的兩種模型,它們在描述和分析電子電路或系統(tǒng)時具有不同的特點(diǎn)和應(yīng)用范圍。以下是關(guān)于大信號模型和小信號模型區(qū)別的介紹。 大信號模型:大信號模型主要用于描述
2023-12-19 11:35:553424

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