CMOS壓電激勵(lì)器
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壓電激勵(lì)與主動(dòng)控制|壓電促動(dòng)器應(yīng)用于振動(dòng)激勵(lì)與主動(dòng)振動(dòng)控制!
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激勵(lì)器的使用_激勵(lì)器怎么連接
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新型CMOS圖像傳感器的原理是什么?
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激勵(lì)器是什么_激勵(lì)器的作用有哪些?
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一文解讀激勵(lì)器改善音頻質(zhì)量的方法
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研究MEMS/NEMS振蕩器諧振頻率的激勵(lì)和探測(cè),其目的是完成超小力的探測(cè)、微機(jī)械混頻器和濾波器的制作等。使微
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針對(duì)數(shù)據(jù)激勵(lì)生成器中定向激勵(lì)和隨機(jī)激勵(lì)生成技術(shù)耗時(shí)長(zhǎng)、跨平臺(tái)使用時(shí)工作量大的問(wèn)題,結(jié)合自主數(shù)據(jù)激勵(lì)和響應(yīng)數(shù)據(jù)激勵(lì)2種激勵(lì)產(chǎn)生方式,以內(nèi)部邏輯自動(dòng)機(jī)為核心,設(shè)計(jì)一種通用可配置的數(shù)據(jù)激勵(lì)器。在戰(zhàn)車導(dǎo)航
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傳感器技術(shù)實(shí)驗(yàn):霍爾式傳感器的直流激勵(lì)特性實(shí)驗(yàn)#傳感器
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行預(yù)激勵(lì)電路
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行激勵(lì)管一般也是按開(kāi)關(guān)方式工作的。它對(duì)行輸出管的激勵(lì)方式可有兩種: 一種是使行輸出管導(dǎo)通時(shí), 行激勵(lì)管
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激勵(lì)器、分頻器、均衡器、壓縮限幅器定義詳解
本文主要詳解什么是激勵(lì)器、分頻器、均衡器、壓縮限幅器,最后還介紹了均衡器與激勵(lì)器的區(qū)別,具體的跟隨小編一起來(lái)了解一下。
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在開(kāi)關(guān)電源中,激勵(lì)電路十分重要,特
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2010-12-13 21:45:4644
數(shù)字控制功率和調(diào)制的可視激勵(lì)驅(qū)動(dòng)器
本文主要講述的是數(shù)字控制功率和調(diào)制的可視激勵(lì)驅(qū)動(dòng)器。
2009-04-22 11:38:0216
基于數(shù)字信號(hào)處理器實(shí)現(xiàn)激勵(lì)器控制系統(tǒng)的設(shè)計(jì)
激勵(lì)器是為發(fā)射機(jī)提供高精度、高穩(wěn)定載波的器件。目前許多激勵(lì)器的控制系統(tǒng)因其核心器件(如MCS-51)速度和精度的限制,存在頻率同步精度低,校頻速度慢等問(wèn)題。DSP可實(shí)現(xiàn)復(fù)雜控制規(guī)律、抗干擾能力強(qiáng)
2020-11-30 12:04:00922
激勵(lì)器調(diào)節(jié)方法及調(diào)控參數(shù)
激勵(lì)器的主要調(diào)控參數(shù)有門限、調(diào)諧點(diǎn)、諧波量、音品和混合比等,它們聯(lián)動(dòng)產(chǎn)生所要恢復(fù)的高頻諧波。
2019-11-27 09:47:346129
電磁聲發(fā)射的脈沖激勵(lì)源設(shè)計(jì)
加載實(shí)驗(yàn)中對(duì)激勵(lì)源的要求,設(shè)計(jì)基于半橋型開(kāi)關(guān)電路原理的可調(diào)穩(wěn)壓電源、以電容器作為儲(chǔ)能元件的充放電回路,并利用單片機(jī)實(shí)現(xiàn)對(duì)電容充放電過(guò)程的調(diào)控,以產(chǎn)生頻率和幅值可調(diào)的脈沖電流。將激勵(lì)源應(yīng)用于電磁加載實(shí)驗(yàn),輸出
2018-01-22 16:21:051
傳感器與測(cè)試技術(shù):振動(dòng)的激勵(lì)#傳感器
傳感器測(cè)試技術(shù)振動(dòng)激勵(lì)
學(xué)習(xí)電子發(fā)布于 2022-11-07 15:57:12
SilTerra開(kāi)發(fā)MEMS-on-CMOS平臺(tái)擴(kuò)展新應(yīng)用
SilTerra一直在開(kāi)發(fā)其MEMS-on-CMOS平臺(tái),并將其擴(kuò)展到新的應(yīng)用,例如:醫(yī)療和指紋傳感器應(yīng)用的PMUT(壓電MEMS超聲換能器)。
2018-12-23 14:20:544084
(76)Verilog HDL測(cè)試激勵(lì):時(shí)鐘激勵(lì)3
(76)Verilog HDL測(cè)試激勵(lì):時(shí)鐘激勵(lì)31.1 目錄1)目錄2)FPGA簡(jiǎn)介3)Verilog HDL簡(jiǎn)介4)Verilog HDL測(cè)試激勵(lì):時(shí)鐘激勵(lì)35)結(jié)語(yǔ)1.2 FPGA簡(jiǎn)介FPGA
2021-12-29 19:43:002
評(píng)論
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